Enum SVE_MISC 

pub enum SVE_MISC {
    ADDPL_Rd_SP_SVE_Rn_SP_SVE_SIMM6(ADDPL_Rd_SP_SVE_Rn_SP_SVE_SIMM6),
    ADDVL_Rd_SP_SVE_Rn_SP_SVE_SIMM6(ADDVL_Rd_SP_SVE_Rn_SP_SVE_SIMM6),
    ADR_SVE_Zd_SVE_ADDR_ZZ_SXTW(ADR_SVE_Zd_SVE_ADDR_ZZ_SXTW),
    ADR_SVE_Zd_SVE_ADDR_ZZ_UXTW(ADR_SVE_Zd_SVE_ADDR_ZZ_UXTW),
    AESD_SVE_Zd_SVE_Zd_SVE_Zn(AESD_SVE_Zd_SVE_Zd_SVE_Zn),
    AESE_SVE_Zd_SVE_Zd_SVE_Zn(AESE_SVE_Zd_SVE_Zd_SVE_Zn),
    AESIMC_SVE_Zd_SVE_Zd(AESIMC_SVE_Zd_SVE_Zd),
    AESMC_SVE_Zd_SVE_Zd(AESMC_SVE_Zd_SVE_Zd),
    ANDS_SVE_Pd_SVE_Pg4_10_SVE_Pn_SVE_Pm(ANDS_SVE_Pd_SVE_Pg4_10_SVE_Pn_SVE_Pm),
    AND_SVE_Pd_SVE_Pg4_10_SVE_Pn_SVE_Pm(AND_SVE_Pd_SVE_Pg4_10_SVE_Pn_SVE_Pm),
    AND_SVE_Zd_SVE_Zn_SVE_Zm_16(AND_SVE_Zd_SVE_Zn_SVE_Zm_16),
    BCAX_SVE_Zd_SVE_Zd_SVE_Zm_16_SVE_Zn(BCAX_SVE_Zd_SVE_Zd_SVE_Zm_16_SVE_Zn),
    BFADD_SVE_Zd_SVE_Pg3_SVE_Zd_SVE_Zm_5(BFADD_SVE_Zd_SVE_Pg3_SVE_Zd_SVE_Zm_5),
    BFADD_SVE_Zd_SVE_Zn_SVE_Zm_16(BFADD_SVE_Zd_SVE_Zn_SVE_Zm_16),
    BFCLAMP_SVE_Zd_SVE_Zn_SVE_Zm_16(BFCLAMP_SVE_Zd_SVE_Zn_SVE_Zm_16),
    BFCVTNT_SVE_Zd_SVE_Pg3_SVE_Zn(BFCVTNT_SVE_Zd_SVE_Pg3_SVE_Zn),
    BFCVT_SVE_Zd_SVE_Pg3_SVE_Zn(BFCVT_SVE_Zd_SVE_Pg3_SVE_Zn),
    BFDOT_SVE_Zd_SVE_Zn_SVE_Zm3_INDEX(BFDOT_SVE_Zd_SVE_Zn_SVE_Zm3_INDEX),
    BFDOT_SVE_Zd_SVE_Zn_SVE_Zm_16(BFDOT_SVE_Zd_SVE_Zn_SVE_Zm_16),
    BFMAXNM_SVE_Zd_SVE_Pg3_SVE_Zd_SVE_Zm_5(BFMAXNM_SVE_Zd_SVE_Pg3_SVE_Zd_SVE_Zm_5),
    BFMAX_SVE_Zd_SVE_Pg3_SVE_Zd_SVE_Zm_5(BFMAX_SVE_Zd_SVE_Pg3_SVE_Zd_SVE_Zm_5),
    BFMINNM_SVE_Zd_SVE_Pg3_SVE_Zd_SVE_Zm_5(BFMINNM_SVE_Zd_SVE_Pg3_SVE_Zd_SVE_Zm_5),
    BFMIN_SVE_Zd_SVE_Pg3_SVE_Zd_SVE_Zm_5(BFMIN_SVE_Zd_SVE_Pg3_SVE_Zd_SVE_Zm_5),
    BFMLALB_SVE_Zd_SVE_Zn_SVE_Zm3_11_INDEX(BFMLALB_SVE_Zd_SVE_Zn_SVE_Zm3_11_INDEX),
    BFMLALB_SVE_Zd_SVE_Zn_SVE_Zm_16(BFMLALB_SVE_Zd_SVE_Zn_SVE_Zm_16),
    BFMLALT_SVE_Zd_SVE_Zn_SVE_Zm3_11_INDEX(BFMLALT_SVE_Zd_SVE_Zn_SVE_Zm3_11_INDEX),
    BFMLALT_SVE_Zd_SVE_Zn_SVE_Zm_16(BFMLALT_SVE_Zd_SVE_Zn_SVE_Zm_16),
    BFMLA_SVE_Zd_SVE_Pg3_SVE_Zn_SVE_Zm_16(BFMLA_SVE_Zd_SVE_Pg3_SVE_Zn_SVE_Zm_16),
    BFMLA_SVE_Zd_SVE_Zn_SVE_Zm3_11_INDEX(BFMLA_SVE_Zd_SVE_Zn_SVE_Zm3_11_INDEX),
    BFMLSLB_SVE_Zd_SVE_Zn_SVE_Zm3_11_INDEX(BFMLSLB_SVE_Zd_SVE_Zn_SVE_Zm3_11_INDEX),
    BFMLSLB_SVE_Zd_SVE_Zn_SVE_Zm_16(BFMLSLB_SVE_Zd_SVE_Zn_SVE_Zm_16),
    BFMLSLT_SVE_Zd_SVE_Zn_SVE_Zm3_11_INDEX(BFMLSLT_SVE_Zd_SVE_Zn_SVE_Zm3_11_INDEX),
    BFMLSLT_SVE_Zd_SVE_Zn_SVE_Zm_16(BFMLSLT_SVE_Zd_SVE_Zn_SVE_Zm_16),
    BFMLS_SVE_Zd_SVE_Pg3_SVE_Zn_SVE_Zm_16(BFMLS_SVE_Zd_SVE_Pg3_SVE_Zn_SVE_Zm_16),
    BFMLS_SVE_Zd_SVE_Zn_SVE_Zm3_11_INDEX(BFMLS_SVE_Zd_SVE_Zn_SVE_Zm3_11_INDEX),
    BFMMLA_SVE_Zd_SVE_Zn_SVE_Zm_16(BFMMLA_SVE_Zd_SVE_Zn_SVE_Zm_16),
    BFMUL_SVE_Zd_SVE_Pg3_SVE_Zd_SVE_Zm_5(BFMUL_SVE_Zd_SVE_Pg3_SVE_Zd_SVE_Zm_5),
    BFMUL_SVE_Zd_SVE_Zn_SVE_Zm3_11_INDEX(BFMUL_SVE_Zd_SVE_Zn_SVE_Zm3_11_INDEX),
    BFMUL_SVE_Zd_SVE_Zn_SVE_Zm_16(BFMUL_SVE_Zd_SVE_Zn_SVE_Zm_16),
    BFSUB_SVE_Zd_SVE_Pg3_SVE_Zd_SVE_Zm_5(BFSUB_SVE_Zd_SVE_Pg3_SVE_Zd_SVE_Zm_5),
    BFSUB_SVE_Zd_SVE_Zn_SVE_Zm_16(BFSUB_SVE_Zd_SVE_Zn_SVE_Zm_16),
    BICS_SVE_Pd_SVE_Pg4_10_SVE_Pn_SVE_Pm(BICS_SVE_Pd_SVE_Pg4_10_SVE_Pn_SVE_Pm),
    BIC_SVE_Pd_SVE_Pg4_10_SVE_Pn_SVE_Pm(BIC_SVE_Pd_SVE_Pg4_10_SVE_Pn_SVE_Pm),
    BIC_SVE_Zd_SVE_Zn_SVE_Zm_16(BIC_SVE_Zd_SVE_Zn_SVE_Zm_16),
    BRKAS_SVE_Pd_SVE_Pg4_10_SVE_Pn(BRKAS_SVE_Pd_SVE_Pg4_10_SVE_Pn),
    BRKBS_SVE_Pd_SVE_Pg4_10_SVE_Pn(BRKBS_SVE_Pd_SVE_Pg4_10_SVE_Pn),
    BRKNS_SVE_Pd_SVE_Pg4_10_SVE_Pn_SVE_Pd(BRKNS_SVE_Pd_SVE_Pg4_10_SVE_Pn_SVE_Pd),
    BRKN_SVE_Pd_SVE_Pg4_10_SVE_Pn_SVE_Pd(BRKN_SVE_Pd_SVE_Pg4_10_SVE_Pn_SVE_Pd),
    BRKPAS_SVE_Pd_SVE_Pg4_10_SVE_Pn_SVE_Pm(BRKPAS_SVE_Pd_SVE_Pg4_10_SVE_Pn_SVE_Pm),
    BRKPA_SVE_Pd_SVE_Pg4_10_SVE_Pn_SVE_Pm(BRKPA_SVE_Pd_SVE_Pg4_10_SVE_Pn_SVE_Pm),
    BRKPBS_SVE_Pd_SVE_Pg4_10_SVE_Pn_SVE_Pm(BRKPBS_SVE_Pd_SVE_Pg4_10_SVE_Pn_SVE_Pm),
    BRKPB_SVE_Pd_SVE_Pg4_10_SVE_Pn_SVE_Pm(BRKPB_SVE_Pd_SVE_Pg4_10_SVE_Pn_SVE_Pm),
    BSL1N_SVE_Zd_SVE_Zd_SVE_Zm_16_SVE_Zn(BSL1N_SVE_Zd_SVE_Zd_SVE_Zm_16_SVE_Zn),
    BSL2N_SVE_Zd_SVE_Zd_SVE_Zm_16_SVE_Zn(BSL2N_SVE_Zd_SVE_Zd_SVE_Zm_16_SVE_Zn),
    BSL_SVE_Zd_SVE_Zd_SVE_Zm_16_SVE_Zn(BSL_SVE_Zd_SVE_Zd_SVE_Zm_16_SVE_Zn),
    CDOT_SVE_Zd_SVE_Zn_SVE_Zm3_INDEX_SVE_IMM_ROT2(CDOT_SVE_Zd_SVE_Zn_SVE_Zm3_INDEX_SVE_IMM_ROT2),
    CDOT_SVE_Zd_SVE_Zn_SVE_Zm4_INDEX_SVE_IMM_ROT2(CDOT_SVE_Zd_SVE_Zn_SVE_Zm4_INDEX_SVE_IMM_ROT2),
    CMLA_SVE_Zd_SVE_Zn_SVE_Zm3_INDEX_SVE_IMM_ROT2(CMLA_SVE_Zd_SVE_Zn_SVE_Zm3_INDEX_SVE_IMM_ROT2),
    CMLA_SVE_Zd_SVE_Zn_SVE_Zm4_INDEX_SVE_IMM_ROT2(CMLA_SVE_Zd_SVE_Zn_SVE_Zm4_INDEX_SVE_IMM_ROT2),
    CNTB_Rd_SVE_PATTERN_SCALED(CNTB_Rd_SVE_PATTERN_SCALED),
    CNTD_Rd_SVE_PATTERN_SCALED(CNTD_Rd_SVE_PATTERN_SCALED),
    CNTH_Rd_SVE_PATTERN_SCALED(CNTH_Rd_SVE_PATTERN_SCALED),
    CNTW_Rd_SVE_PATTERN_SCALED(CNTW_Rd_SVE_PATTERN_SCALED),
    DECB_Rd_SVE_PATTERN_SCALED(DECB_Rd_SVE_PATTERN_SCALED),
    DECD_Rd_SVE_PATTERN_SCALED(DECD_Rd_SVE_PATTERN_SCALED),
    DECD_SVE_Zd_SVE_PATTERN_SCALED(DECD_SVE_Zd_SVE_PATTERN_SCALED),
    DECH_Rd_SVE_PATTERN_SCALED(DECH_Rd_SVE_PATTERN_SCALED),
    DECH_SVE_Zd_SVE_PATTERN_SCALED(DECH_SVE_Zd_SVE_PATTERN_SCALED),
    DECW_Rd_SVE_PATTERN_SCALED(DECW_Rd_SVE_PATTERN_SCALED),
    DECW_SVE_Zd_SVE_PATTERN_SCALED(DECW_SVE_Zd_SVE_PATTERN_SCALED),
    EOR3_SVE_Zd_SVE_Zd_SVE_Zm_16_SVE_Zn(EOR3_SVE_Zd_SVE_Zd_SVE_Zm_16_SVE_Zn),
    EORS_SVE_Pd_SVE_Pg4_10_SVE_Pn_SVE_Pm(EORS_SVE_Pd_SVE_Pg4_10_SVE_Pn_SVE_Pm),
    EOR_SVE_Pd_SVE_Pg4_10_SVE_Pn_SVE_Pm(EOR_SVE_Pd_SVE_Pg4_10_SVE_Pn_SVE_Pm),
    EOR_SVE_Zd_SVE_Zn_SVE_Zm_16(EOR_SVE_Zd_SVE_Zn_SVE_Zm_16),
    EXTQ_SVE_Zd_SVE_Zd_SVE_Zm_imm4(EXTQ_SVE_Zd_SVE_Zd_SVE_Zm_imm4),
    EXT_SVE_Zd_SVE_Zd_SVE_Zm_5_SVE_UIMM8_53(EXT_SVE_Zd_SVE_Zd_SVE_Zm_5_SVE_UIMM8_53),
    EXT_SVE_Zd_SVE_ZnxN_SVE_UIMM8_53(EXT_SVE_Zd_SVE_ZnxN_SVE_UIMM8_53),
    FCMLA_SVE_Zd_SVE_Zn_SVE_Zm3_INDEX_SVE_IMM_ROT2(FCMLA_SVE_Zd_SVE_Zn_SVE_Zm3_INDEX_SVE_IMM_ROT2),
    FCMLA_SVE_Zd_SVE_Zn_SVE_Zm4_INDEX_SVE_IMM_ROT2(FCMLA_SVE_Zd_SVE_Zn_SVE_Zm4_INDEX_SVE_IMM_ROT2),
    FCVTLT_SVE_Zd_SVE_Pg3_SVE_Zn(FCVTLT_SVE_Zd_SVE_Pg3_SVE_Zn),
    FCVTLT_SVE_Zd_S_D_SVE_Pg3_P_M_SVE_Zn_S_S(FCVTLT_SVE_Zd_S_D_SVE_Pg3_P_M_SVE_Zn_S_S),
    FCVTNT_SVE_Zd_SVE_Pg3_SVE_Zn(FCVTNT_SVE_Zd_SVE_Pg3_SVE_Zn),
    FCVTNT_SVE_Zd_S_S_SVE_Pg3_P_M_SVE_Zn_S_D(FCVTNT_SVE_Zd_S_S_SVE_Pg3_P_M_SVE_Zn_S_D),
    FCVTN_SVE_Zd_SME_Znx2(FCVTN_SVE_Zd_SME_Znx2),
    FCVTXNT_SVE_Zd_SVE_Pg3_SVE_Zn(FCVTXNT_SVE_Zd_SVE_Pg3_SVE_Zn),
    FCVTX_SVE_Zd_SVE_Pg3_SVE_Zn(FCVTX_SVE_Zd_SVE_Pg3_SVE_Zn),
    FCVTZS_SME_Zdnx2_SME_Znx2(FCVTZS_SME_Zdnx2_SME_Znx2),
    FCVTZS_SME_Zdnx4_SME_Znx4(FCVTZS_SME_Zdnx4_SME_Znx4),
    FCVTZS_SVE_Zd_SVE_Pg3_SVE_Zn(FCVTZS_SVE_Zd_SVE_Pg3_SVE_Zn),
    FCVTZS_SVE_Zd_S_D_SVE_Pg3_P_M_SVE_Zn_S_D(FCVTZS_SVE_Zd_S_D_SVE_Pg3_P_M_SVE_Zn_S_D),
    FCVTZS_SVE_Zd_S_D_SVE_Pg3_P_M_SVE_Zn_S_H(FCVTZS_SVE_Zd_S_D_SVE_Pg3_P_M_SVE_Zn_S_H),
    FCVTZS_SVE_Zd_S_D_SVE_Pg3_P_M_SVE_Zn_S_S(FCVTZS_SVE_Zd_S_D_SVE_Pg3_P_M_SVE_Zn_S_S),
    FCVTZS_SVE_Zd_S_H_SVE_Pg3_P_M_SVE_Zn_S_H(FCVTZS_SVE_Zd_S_H_SVE_Pg3_P_M_SVE_Zn_S_H),
    FCVTZS_SVE_Zd_S_S_SVE_Pg3_P_M_SVE_Zn_S_D(FCVTZS_SVE_Zd_S_S_SVE_Pg3_P_M_SVE_Zn_S_D),
    FCVTZS_SVE_Zd_S_S_SVE_Pg3_P_M_SVE_Zn_S_H(FCVTZS_SVE_Zd_S_S_SVE_Pg3_P_M_SVE_Zn_S_H),
    FCVTZU_SME_Zdnx2_SME_Znx2(FCVTZU_SME_Zdnx2_SME_Znx2),
    FCVTZU_SME_Zdnx4_SME_Znx4(FCVTZU_SME_Zdnx4_SME_Znx4),
    FCVTZU_SVE_Zd_SVE_Pg3_SVE_Zn(FCVTZU_SVE_Zd_SVE_Pg3_SVE_Zn),
    FCVTZU_SVE_Zd_S_D_SVE_Pg3_P_M_SVE_Zn_S_D(FCVTZU_SVE_Zd_S_D_SVE_Pg3_P_M_SVE_Zn_S_D),
    FCVTZU_SVE_Zd_S_D_SVE_Pg3_P_M_SVE_Zn_S_H(FCVTZU_SVE_Zd_S_D_SVE_Pg3_P_M_SVE_Zn_S_H),
    FCVTZU_SVE_Zd_S_D_SVE_Pg3_P_M_SVE_Zn_S_S(FCVTZU_SVE_Zd_S_D_SVE_Pg3_P_M_SVE_Zn_S_S),
    FCVTZU_SVE_Zd_S_H_SVE_Pg3_P_M_SVE_Zn_S_H(FCVTZU_SVE_Zd_S_H_SVE_Pg3_P_M_SVE_Zn_S_H),
    FCVTZU_SVE_Zd_S_S_SVE_Pg3_P_M_SVE_Zn_S_H(FCVTZU_SVE_Zd_S_S_SVE_Pg3_P_M_SVE_Zn_S_H),
    FCVTZU_SVE_Zd_S_S_SVE_Pg3_P_M_SVE_Zn_S_S(FCVTZU_SVE_Zd_S_S_SVE_Pg3_P_M_SVE_Zn_S_S),
    FCVT_SVE_Zd_SME_Znx2(FCVT_SVE_Zd_SME_Znx2),
    FCVT_SVE_Zd_SVE_Pg3_SVE_Zn(FCVT_SVE_Zd_SVE_Pg3_SVE_Zn),
    FCVT_SVE_Zd_S_D_SVE_Pg3_P_M_SVE_Zn_S_H(FCVT_SVE_Zd_S_D_SVE_Pg3_P_M_SVE_Zn_S_H),
    FCVT_SVE_Zd_S_D_SVE_Pg3_P_M_SVE_Zn_S_S(FCVT_SVE_Zd_S_D_SVE_Pg3_P_M_SVE_Zn_S_S),
    FCVT_SVE_Zd_S_H_SVE_Pg3_P_M_SVE_Zn_S_D(FCVT_SVE_Zd_S_H_SVE_Pg3_P_M_SVE_Zn_S_D),
    FCVT_SVE_Zd_S_S_SVE_Pg3_P_M_SVE_Zn_S_D(FCVT_SVE_Zd_S_S_SVE_Pg3_P_M_SVE_Zn_S_D),
    FCVT_SVE_Zd_S_S_SVE_Pg3_P_M_SVE_Zn_S_H(FCVT_SVE_Zd_S_S_SVE_Pg3_P_M_SVE_Zn_S_H),
    FDOT_SVE_Zd_SVE_Zn_SVE_Zm3_19_INDEX(FDOT_SVE_Zd_SVE_Zn_SVE_Zm3_19_INDEX),
    FDOT_SVE_Zd_SVE_Zn_SVE_Zm_16(FDOT_SVE_Zd_SVE_Zn_SVE_Zm_16),
    FMLALB_SVE_Zd_SVE_Zn_SVE_Zm3_11_INDEX(FMLALB_SVE_Zd_SVE_Zn_SVE_Zm3_11_INDEX),
    FMLALB_SVE_Zd_SVE_Zn_SVE_Zm_16(FMLALB_SVE_Zd_SVE_Zn_SVE_Zm_16),
    FMLALT_SVE_Zd_SVE_Zn_SVE_Zm3_11_INDEX(FMLALT_SVE_Zd_SVE_Zn_SVE_Zm3_11_INDEX),
    FMLALT_SVE_Zd_SVE_Zn_SVE_Zm_16(FMLALT_SVE_Zd_SVE_Zn_SVE_Zm_16),
    FMLA_SVE_Zd_SVE_Zn_SVE_Zm3_22_INDEX(FMLA_SVE_Zd_SVE_Zn_SVE_Zm3_22_INDEX),
    FMLA_SVE_Zd_SVE_Zn_SVE_Zm3_INDEX(FMLA_SVE_Zd_SVE_Zn_SVE_Zm3_INDEX),
    FMLA_SVE_Zd_SVE_Zn_SVE_Zm4_INDEX(FMLA_SVE_Zd_SVE_Zn_SVE_Zm4_INDEX),
    FMLSLB_SVE_Zd_SVE_Zn_SVE_Zm3_11_INDEX(FMLSLB_SVE_Zd_SVE_Zn_SVE_Zm3_11_INDEX),
    FMLSLB_SVE_Zd_SVE_Zn_SVE_Zm_16(FMLSLB_SVE_Zd_SVE_Zn_SVE_Zm_16),
    FMLSLT_SVE_Zd_SVE_Zn_SVE_Zm3_11_INDEX(FMLSLT_SVE_Zd_SVE_Zn_SVE_Zm3_11_INDEX),
    FMLSLT_SVE_Zd_SVE_Zn_SVE_Zm_16(FMLSLT_SVE_Zd_SVE_Zn_SVE_Zm_16),
    FMLS_SVE_Zd_SVE_Zn_SVE_Zm3_22_INDEX(FMLS_SVE_Zd_SVE_Zn_SVE_Zm3_22_INDEX),
    FMLS_SVE_Zd_SVE_Zn_SVE_Zm3_INDEX(FMLS_SVE_Zd_SVE_Zn_SVE_Zm3_INDEX),
    FMLS_SVE_Zd_SVE_Zn_SVE_Zm4_INDEX(FMLS_SVE_Zd_SVE_Zn_SVE_Zm4_INDEX),
    FMMLA_SVE_Zd_SVE_Zn_SVE_Zm_16(FMMLA_SVE_Zd_SVE_Zn_SVE_Zm_16),
    FMMLA_SVE_Zd_S_D_SVE_Zn_S_D_SVE_Zm_16_S_D(FMMLA_SVE_Zd_S_D_SVE_Zn_S_D_SVE_Zm_16_S_D),
    FMUL_SVE_Zd_SVE_Zn_SVE_Zm3_22_INDEX(FMUL_SVE_Zd_SVE_Zn_SVE_Zm3_22_INDEX),
    FMUL_SVE_Zd_SVE_Zn_SVE_Zm3_INDEX(FMUL_SVE_Zd_SVE_Zn_SVE_Zm3_INDEX),
    FMUL_SVE_Zd_SVE_Zn_SVE_Zm4_INDEX(FMUL_SVE_Zd_SVE_Zn_SVE_Zm4_INDEX),
    FRINTA_SME_Zdnx2_SME_Znx2(FRINTA_SME_Zdnx2_SME_Znx2),
    FRINTA_SME_Zdnx4_SME_Znx4(FRINTA_SME_Zdnx4_SME_Znx4),
    FRINTM_SME_Zdnx2_SME_Znx2(FRINTM_SME_Zdnx2_SME_Znx2),
    FRINTM_SME_Zdnx4_SME_Znx4(FRINTM_SME_Zdnx4_SME_Znx4),
    FRINTN_SME_Zdnx2_SME_Znx2(FRINTN_SME_Zdnx2_SME_Znx2),
    FRINTN_SME_Zdnx4_SME_Znx4(FRINTN_SME_Zdnx4_SME_Znx4),
    FRINTP_SME_Zdnx2_SME_Znx2(FRINTP_SME_Zdnx2_SME_Znx2),
    FRINTP_SME_Zdnx4_SME_Znx4(FRINTP_SME_Zdnx4_SME_Znx4),
    HISTSEG_SVE_Zd_SVE_Zn_SVE_Zm_16(HISTSEG_SVE_Zd_SVE_Zn_SVE_Zm_16),
    INCB_Rd_SVE_PATTERN_SCALED(INCB_Rd_SVE_PATTERN_SCALED),
    INCD_Rd_SVE_PATTERN_SCALED(INCD_Rd_SVE_PATTERN_SCALED),
    INCD_SVE_Zd_SVE_PATTERN_SCALED(INCD_SVE_Zd_SVE_PATTERN_SCALED),
    INCH_Rd_SVE_PATTERN_SCALED(INCH_Rd_SVE_PATTERN_SCALED),
    INCH_SVE_Zd_SVE_PATTERN_SCALED(INCH_SVE_Zd_SVE_PATTERN_SCALED),
    INCW_Rd_SVE_PATTERN_SCALED(INCW_Rd_SVE_PATTERN_SCALED),
    INCW_SVE_Zd_SVE_PATTERN_SCALED(INCW_SVE_Zd_SVE_PATTERN_SCALED),
    LD1B_SME_ZA_HV_idx_ldstr_SVE_Pg3_SVE_ADDR_R(LD1B_SME_ZA_HV_idx_ldstr_SVE_Pg3_SVE_ADDR_R),
    LD1B_SME_ZA_HV_idx_ldstr_SVE_Pg3_SVE_ADDR_RR(LD1B_SME_ZA_HV_idx_ldstr_SVE_Pg3_SVE_ADDR_RR),
    LD1B_SME_Zdnx2_SME_PNg3_SVE_ADDR_RI_S4x2xVL(LD1B_SME_Zdnx2_SME_PNg3_SVE_ADDR_RI_S4x2xVL),
    LD1B_SME_Zdnx2_SME_PNg3_SVE_ADDR_RR(LD1B_SME_Zdnx2_SME_PNg3_SVE_ADDR_RR),
    LD1B_SME_Zdnx4_SME_PNg3_SVE_ADDR_RI_S4x4xVL(LD1B_SME_Zdnx4_SME_PNg3_SVE_ADDR_RI_S4x4xVL),
    LD1B_SME_Zdnx4_SME_PNg3_SVE_ADDR_RR(LD1B_SME_Zdnx4_SME_PNg3_SVE_ADDR_RR),
    LD1B_SME_Ztx2_STRIDED_SME_PNg3_SVE_ADDR_RI_S4x2xVL(LD1B_SME_Ztx2_STRIDED_SME_PNg3_SVE_ADDR_RI_S4x2xVL),
    LD1B_SME_Ztx2_STRIDED_SME_PNg3_SVE_ADDR_RR(LD1B_SME_Ztx2_STRIDED_SME_PNg3_SVE_ADDR_RR),
    LD1B_SME_Ztx4_STRIDED_SME_PNg3_SVE_ADDR_RI_S4x4xVL(LD1B_SME_Ztx4_STRIDED_SME_PNg3_SVE_ADDR_RI_S4x4xVL),
    LD1B_SME_Ztx4_STRIDED_SME_PNg3_SVE_ADDR_RR(LD1B_SME_Ztx4_STRIDED_SME_PNg3_SVE_ADDR_RR),
    LD1B_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RI_S4xVL(LD1B_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RI_S4xVL),
    LD1B_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RX(LD1B_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RX),
    LD1B_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RZ(LD1B_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RZ),
    LD1B_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RZ_XTW_22(LD1B_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RZ_XTW_22),
    LD1B_SVE_ZtxN_SVE_Pg3_SVE_ADDR_ZI_U5(LD1B_SVE_ZtxN_SVE_Pg3_SVE_ADDR_ZI_U5),
    LD1B_SVE_ZtxN_S_D_SVE_Pg3_P_Z_SVE_ADDR_RI_S4xVL(LD1B_SVE_ZtxN_S_D_SVE_Pg3_P_Z_SVE_ADDR_RI_S4xVL),
    LD1B_SVE_ZtxN_S_D_SVE_Pg3_P_Z_SVE_ADDR_RX(LD1B_SVE_ZtxN_S_D_SVE_Pg3_P_Z_SVE_ADDR_RX),
    LD1B_SVE_ZtxN_S_D_SVE_Pg3_P_Z_SVE_ADDR_RZ_XTW_22_S_D(LD1B_SVE_ZtxN_S_D_SVE_Pg3_P_Z_SVE_ADDR_RZ_XTW_22_S_D),
    LD1B_SVE_ZtxN_S_D_SVE_Pg3_P_Z_SVE_ADDR_ZI_U5_S_D(LD1B_SVE_ZtxN_S_D_SVE_Pg3_P_Z_SVE_ADDR_ZI_U5_S_D),
    LD1B_SVE_ZtxN_S_H_SVE_Pg3_P_Z_SVE_ADDR_RI_S4xVL(LD1B_SVE_ZtxN_S_H_SVE_Pg3_P_Z_SVE_ADDR_RI_S4xVL),
    LD1B_SVE_ZtxN_S_H_SVE_Pg3_P_Z_SVE_ADDR_RX(LD1B_SVE_ZtxN_S_H_SVE_Pg3_P_Z_SVE_ADDR_RX),
    LD1B_SVE_ZtxN_S_S_SVE_Pg3_P_Z_SVE_ADDR_RI_S4xVL(LD1B_SVE_ZtxN_S_S_SVE_Pg3_P_Z_SVE_ADDR_RI_S4xVL),
    LD1B_SVE_ZtxN_S_S_SVE_Pg3_P_Z_SVE_ADDR_RX(LD1B_SVE_ZtxN_S_S_SVE_Pg3_P_Z_SVE_ADDR_RX),
    LD1D_SME_ZA_HV_idx_ldstr_SVE_Pg3_SVE_ADDR_R(LD1D_SME_ZA_HV_idx_ldstr_SVE_Pg3_SVE_ADDR_R),
    LD1D_SME_ZA_HV_idx_ldstr_SVE_Pg3_SVE_ADDR_RR_LSL3(LD1D_SME_ZA_HV_idx_ldstr_SVE_Pg3_SVE_ADDR_RR_LSL3),
    LD1D_SME_Zdnx2_SME_PNg3_SVE_ADDR_RI_S4x2xVL(LD1D_SME_Zdnx2_SME_PNg3_SVE_ADDR_RI_S4x2xVL),
    LD1D_SME_Zdnx2_SME_PNg3_SVE_ADDR_RR_LSL3(LD1D_SME_Zdnx2_SME_PNg3_SVE_ADDR_RR_LSL3),
    LD1D_SME_Zdnx4_SME_PNg3_SVE_ADDR_RI_S4x4xVL(LD1D_SME_Zdnx4_SME_PNg3_SVE_ADDR_RI_S4x4xVL),
    LD1D_SME_Zdnx4_SME_PNg3_SVE_ADDR_RR_LSL3(LD1D_SME_Zdnx4_SME_PNg3_SVE_ADDR_RR_LSL3),
    LD1D_SME_Ztx2_STRIDED_SME_PNg3_SVE_ADDR_RI_S4x2xVL(LD1D_SME_Ztx2_STRIDED_SME_PNg3_SVE_ADDR_RI_S4x2xVL),
    LD1D_SME_Ztx2_STRIDED_SME_PNg3_SVE_ADDR_RR_LSL3(LD1D_SME_Ztx2_STRIDED_SME_PNg3_SVE_ADDR_RR_LSL3),
    LD1D_SME_Ztx4_STRIDED_SME_PNg3_SVE_ADDR_RI_S4x4xVL(LD1D_SME_Ztx4_STRIDED_SME_PNg3_SVE_ADDR_RI_S4x4xVL),
    LD1D_SME_Ztx4_STRIDED_SME_PNg3_SVE_ADDR_RR_LSL3(LD1D_SME_Ztx4_STRIDED_SME_PNg3_SVE_ADDR_RR_LSL3),
    LD1D_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RI_S4xVL(LD1D_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RI_S4xVL),
    LD1D_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RX_LSL3(LD1D_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RX_LSL3),
    LD1D_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RZ(LD1D_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RZ),
    LD1D_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RZ_LSL3(LD1D_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RZ_LSL3),
    LD1D_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RZ_XTW3_22(LD1D_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RZ_XTW3_22),
    LD1D_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RZ_XTW_22(LD1D_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RZ_XTW_22),
    LD1D_SVE_ZtxN_SVE_Pg3_SVE_ADDR_ZI_U5x8(LD1D_SVE_ZtxN_SVE_Pg3_SVE_ADDR_ZI_U5x8),
    LD1H_SME_ZA_HV_idx_ldstr_SVE_Pg3_SVE_ADDR_R(LD1H_SME_ZA_HV_idx_ldstr_SVE_Pg3_SVE_ADDR_R),
    LD1H_SME_ZA_HV_idx_ldstr_SVE_Pg3_SVE_ADDR_RR_LSL1(LD1H_SME_ZA_HV_idx_ldstr_SVE_Pg3_SVE_ADDR_RR_LSL1),
    LD1H_SME_Zdnx2_SME_PNg3_SVE_ADDR_RI_S4x2xVL(LD1H_SME_Zdnx2_SME_PNg3_SVE_ADDR_RI_S4x2xVL),
    LD1H_SME_Zdnx2_SME_PNg3_SVE_ADDR_RR_LSL1(LD1H_SME_Zdnx2_SME_PNg3_SVE_ADDR_RR_LSL1),
    LD1H_SME_Zdnx4_SME_PNg3_SVE_ADDR_RI_S4x4xVL(LD1H_SME_Zdnx4_SME_PNg3_SVE_ADDR_RI_S4x4xVL),
    LD1H_SME_Zdnx4_SME_PNg3_SVE_ADDR_RR_LSL1(LD1H_SME_Zdnx4_SME_PNg3_SVE_ADDR_RR_LSL1),
    LD1H_SME_Ztx2_STRIDED_SME_PNg3_SVE_ADDR_RI_S4x2xVL(LD1H_SME_Ztx2_STRIDED_SME_PNg3_SVE_ADDR_RI_S4x2xVL),
    LD1H_SME_Ztx2_STRIDED_SME_PNg3_SVE_ADDR_RR_LSL1(LD1H_SME_Ztx2_STRIDED_SME_PNg3_SVE_ADDR_RR_LSL1),
    LD1H_SME_Ztx4_STRIDED_SME_PNg3_SVE_ADDR_RI_S4x4xVL(LD1H_SME_Ztx4_STRIDED_SME_PNg3_SVE_ADDR_RI_S4x4xVL),
    LD1H_SME_Ztx4_STRIDED_SME_PNg3_SVE_ADDR_RR_LSL1(LD1H_SME_Ztx4_STRIDED_SME_PNg3_SVE_ADDR_RR_LSL1),
    LD1H_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RI_S4xVL(LD1H_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RI_S4xVL),
    LD1H_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RX_LSL1(LD1H_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RX_LSL1),
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    LD1H_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RZ_LSL1(LD1H_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RZ_LSL1),
    LD1H_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RZ_XTW1_22(LD1H_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RZ_XTW1_22),
    LD1H_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RZ_XTW_22(LD1H_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RZ_XTW_22),
    LD1H_SVE_ZtxN_SVE_Pg3_SVE_ADDR_ZI_U5x2(LD1H_SVE_ZtxN_SVE_Pg3_SVE_ADDR_ZI_U5x2),
    LD1H_SVE_ZtxN_S_D_SVE_Pg3_P_Z_SVE_ADDR_RI_S4xVL(LD1H_SVE_ZtxN_S_D_SVE_Pg3_P_Z_SVE_ADDR_RI_S4xVL),
    LD1H_SVE_ZtxN_S_D_SVE_Pg3_P_Z_SVE_ADDR_RX_LSL1(LD1H_SVE_ZtxN_S_D_SVE_Pg3_P_Z_SVE_ADDR_RX_LSL1),
    LD1H_SVE_ZtxN_S_D_SVE_Pg3_P_Z_SVE_ADDR_RZ_XTW1_22_S_D(LD1H_SVE_ZtxN_S_D_SVE_Pg3_P_Z_SVE_ADDR_RZ_XTW1_22_S_D),
    LD1H_SVE_ZtxN_S_D_SVE_Pg3_P_Z_SVE_ADDR_RZ_XTW_22_S_D(LD1H_SVE_ZtxN_S_D_SVE_Pg3_P_Z_SVE_ADDR_RZ_XTW_22_S_D),
    LD1H_SVE_ZtxN_S_D_SVE_Pg3_P_Z_SVE_ADDR_ZI_U5x2_S_D(LD1H_SVE_ZtxN_S_D_SVE_Pg3_P_Z_SVE_ADDR_ZI_U5x2_S_D),
    LD1H_SVE_ZtxN_S_H_SVE_Pg3_P_Z_SVE_ADDR_RI_S4xVL(LD1H_SVE_ZtxN_S_H_SVE_Pg3_P_Z_SVE_ADDR_RI_S4xVL),
    LD1H_SVE_ZtxN_S_H_SVE_Pg3_P_Z_SVE_ADDR_RX_LSL1(LD1H_SVE_ZtxN_S_H_SVE_Pg3_P_Z_SVE_ADDR_RX_LSL1),
    LD1Q_SME_ZA_HV_idx_ldstr_SVE_Pg3_SVE_ADDR_R(LD1Q_SME_ZA_HV_idx_ldstr_SVE_Pg3_SVE_ADDR_R),
    LD1Q_SME_ZA_HV_idx_ldstr_SVE_Pg3_SVE_ADDR_RR_LSL4(LD1Q_SME_ZA_HV_idx_ldstr_SVE_Pg3_SVE_ADDR_RR_LSL4),
    LD1Q_SVE_Zt_SVE_Pg3_SVE_ADDR_ZX(LD1Q_SVE_Zt_SVE_Pg3_SVE_ADDR_ZX),
    LD1RB_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RI_U6(LD1RB_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RI_U6),
    LD1RB_SVE_ZtxN_S_D_SVE_Pg3_P_Z_SVE_ADDR_RI_U6(LD1RB_SVE_ZtxN_S_D_SVE_Pg3_P_Z_SVE_ADDR_RI_U6),
    LD1RB_SVE_ZtxN_S_H_SVE_Pg3_P_Z_SVE_ADDR_RI_U6(LD1RB_SVE_ZtxN_S_H_SVE_Pg3_P_Z_SVE_ADDR_RI_U6),
    LD1RB_SVE_ZtxN_S_S_SVE_Pg3_P_Z_SVE_ADDR_RI_U6(LD1RB_SVE_ZtxN_S_S_SVE_Pg3_P_Z_SVE_ADDR_RI_U6),
    LD1RD_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RI_U6x8(LD1RD_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RI_U6x8),
    LD1RH_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RI_U6x2(LD1RH_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RI_U6x2),
    LD1RH_SVE_ZtxN_S_D_SVE_Pg3_P_Z_SVE_ADDR_RI_U6x2(LD1RH_SVE_ZtxN_S_D_SVE_Pg3_P_Z_SVE_ADDR_RI_U6x2),
    LD1RH_SVE_ZtxN_S_H_SVE_Pg3_P_Z_SVE_ADDR_RI_U6x2(LD1RH_SVE_ZtxN_S_H_SVE_Pg3_P_Z_SVE_ADDR_RI_U6x2),
    LD1ROB_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RI_S4x32(LD1ROB_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RI_S4x32),
    LD1ROB_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RX(LD1ROB_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RX),
    LD1ROD_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RI_S4x32(LD1ROD_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RI_S4x32),
    LD1ROD_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RX_LSL3(LD1ROD_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RX_LSL3),
    LD1ROH_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RI_S4x32(LD1ROH_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RI_S4x32),
    LD1ROH_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RX_LSL1(LD1ROH_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RX_LSL1),
    LD1ROW_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RI_S4x32(LD1ROW_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RI_S4x32),
    LD1ROW_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RX_LSL2(LD1ROW_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RX_LSL2),
    LD1RQB_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RI_S4x16(LD1RQB_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RI_S4x16),
    LD1RQB_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RX(LD1RQB_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RX),
    LD1RQD_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RI_S4x16(LD1RQD_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RI_S4x16),
    LD1RQD_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RX_LSL3(LD1RQD_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RX_LSL3),
    LD1RQH_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RI_S4x16(LD1RQH_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RI_S4x16),
    LD1RQH_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RX_LSL1(LD1RQH_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RX_LSL1),
    LD1RQW_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RI_S4x16(LD1RQW_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RI_S4x16),
    LD1RQW_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RX_LSL2(LD1RQW_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RX_LSL2),
    LD1RSB_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RI_U6(LD1RSB_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RI_U6),
    LD1RSB_SVE_ZtxN_S_H_SVE_Pg3_P_Z_SVE_ADDR_RI_U6(LD1RSB_SVE_ZtxN_S_H_SVE_Pg3_P_Z_SVE_ADDR_RI_U6),
    LD1RSB_SVE_ZtxN_S_S_SVE_Pg3_P_Z_SVE_ADDR_RI_U6(LD1RSB_SVE_ZtxN_S_S_SVE_Pg3_P_Z_SVE_ADDR_RI_U6),
    LD1RSH_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RI_U6x2(LD1RSH_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RI_U6x2),
    LD1RSH_SVE_ZtxN_S_S_SVE_Pg3_P_Z_SVE_ADDR_RI_U6x2(LD1RSH_SVE_ZtxN_S_S_SVE_Pg3_P_Z_SVE_ADDR_RI_U6x2),
    LD1RSW_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RI_U6x4(LD1RSW_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RI_U6x4),
    LD1RW_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RI_U6x4(LD1RW_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RI_U6x4),
    LD1RW_SVE_ZtxN_S_D_SVE_Pg3_P_Z_SVE_ADDR_RI_U6x4(LD1RW_SVE_ZtxN_S_D_SVE_Pg3_P_Z_SVE_ADDR_RI_U6x4),
    LD1SB_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RI_S4xVL(LD1SB_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RI_S4xVL),
    LD1SB_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RX(LD1SB_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RX),
    LD1SB_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RZ(LD1SB_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RZ),
    LD1SB_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RZ_XTW_22(LD1SB_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RZ_XTW_22),
    LD1SB_SVE_ZtxN_SVE_Pg3_SVE_ADDR_ZI_U5(LD1SB_SVE_ZtxN_SVE_Pg3_SVE_ADDR_ZI_U5),
    LD1SB_SVE_ZtxN_S_D_SVE_Pg3_P_Z_SVE_ADDR_RZ_XTW_22_S_D(LD1SB_SVE_ZtxN_S_D_SVE_Pg3_P_Z_SVE_ADDR_RZ_XTW_22_S_D),
    LD1SB_SVE_ZtxN_S_D_SVE_Pg3_P_Z_SVE_ADDR_ZI_U5_S_D(LD1SB_SVE_ZtxN_S_D_SVE_Pg3_P_Z_SVE_ADDR_ZI_U5_S_D),
    LD1SB_SVE_ZtxN_S_H_SVE_Pg3_P_Z_SVE_ADDR_RI_S4xVL(LD1SB_SVE_ZtxN_S_H_SVE_Pg3_P_Z_SVE_ADDR_RI_S4xVL),
    LD1SB_SVE_ZtxN_S_H_SVE_Pg3_P_Z_SVE_ADDR_RX(LD1SB_SVE_ZtxN_S_H_SVE_Pg3_P_Z_SVE_ADDR_RX),
    LD1SB_SVE_ZtxN_S_S_SVE_Pg3_P_Z_SVE_ADDR_RI_S4xVL(LD1SB_SVE_ZtxN_S_S_SVE_Pg3_P_Z_SVE_ADDR_RI_S4xVL),
    LD1SB_SVE_ZtxN_S_S_SVE_Pg3_P_Z_SVE_ADDR_RX(LD1SB_SVE_ZtxN_S_S_SVE_Pg3_P_Z_SVE_ADDR_RX),
    LD1SH_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RI_S4xVL(LD1SH_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RI_S4xVL),
    LD1SH_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RX_LSL1(LD1SH_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RX_LSL1),
    LD1SH_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RZ(LD1SH_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RZ),
    LD1SH_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RZ_LSL1(LD1SH_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RZ_LSL1),
    LD1SH_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RZ_XTW1_22(LD1SH_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RZ_XTW1_22),
    LD1SH_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RZ_XTW_22(LD1SH_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RZ_XTW_22),
    LD1SH_SVE_ZtxN_SVE_Pg3_SVE_ADDR_ZI_U5x2(LD1SH_SVE_ZtxN_SVE_Pg3_SVE_ADDR_ZI_U5x2),
    LD1SH_SVE_ZtxN_S_D_SVE_Pg3_P_Z_SVE_ADDR_RZ_XTW1_22_S_D(LD1SH_SVE_ZtxN_S_D_SVE_Pg3_P_Z_SVE_ADDR_RZ_XTW1_22_S_D),
    LD1SH_SVE_ZtxN_S_D_SVE_Pg3_P_Z_SVE_ADDR_RZ_XTW_22_S_D(LD1SH_SVE_ZtxN_S_D_SVE_Pg3_P_Z_SVE_ADDR_RZ_XTW_22_S_D),
    LD1SH_SVE_ZtxN_S_D_SVE_Pg3_P_Z_SVE_ADDR_ZI_U5x2_S_D(LD1SH_SVE_ZtxN_S_D_SVE_Pg3_P_Z_SVE_ADDR_ZI_U5x2_S_D),
    LD1SH_SVE_ZtxN_S_S_SVE_Pg3_P_Z_SVE_ADDR_RI_S4xVL(LD1SH_SVE_ZtxN_S_S_SVE_Pg3_P_Z_SVE_ADDR_RI_S4xVL),
    LD1SH_SVE_ZtxN_S_S_SVE_Pg3_P_Z_SVE_ADDR_RX_LSL1(LD1SH_SVE_ZtxN_S_S_SVE_Pg3_P_Z_SVE_ADDR_RX_LSL1),
    LD1SW_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RI_S4xVL(LD1SW_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RI_S4xVL),
    LD1SW_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RX_LSL2(LD1SW_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RX_LSL2),
    LD1SW_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RZ(LD1SW_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RZ),
    LD1SW_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RZ_LSL2(LD1SW_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RZ_LSL2),
    LD1SW_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RZ_XTW2_22(LD1SW_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RZ_XTW2_22),
    LD1SW_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RZ_XTW_22(LD1SW_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RZ_XTW_22),
    LD1SW_SVE_ZtxN_SVE_Pg3_SVE_ADDR_ZI_U5x4(LD1SW_SVE_ZtxN_SVE_Pg3_SVE_ADDR_ZI_U5x4),
    LD1W_SME_ZA_HV_idx_ldstr_SVE_Pg3_SVE_ADDR_R(LD1W_SME_ZA_HV_idx_ldstr_SVE_Pg3_SVE_ADDR_R),
    LD1W_SME_ZA_HV_idx_ldstr_SVE_Pg3_SVE_ADDR_RR_LSL2(LD1W_SME_ZA_HV_idx_ldstr_SVE_Pg3_SVE_ADDR_RR_LSL2),
    LD1W_SME_Zdnx2_SME_PNg3_SVE_ADDR_RI_S4x2xVL(LD1W_SME_Zdnx2_SME_PNg3_SVE_ADDR_RI_S4x2xVL),
    LD1W_SME_Zdnx2_SME_PNg3_SVE_ADDR_RR_LSL2(LD1W_SME_Zdnx2_SME_PNg3_SVE_ADDR_RR_LSL2),
    LD1W_SME_Zdnx4_SME_PNg3_SVE_ADDR_RI_S4x4xVL(LD1W_SME_Zdnx4_SME_PNg3_SVE_ADDR_RI_S4x4xVL),
    LD1W_SME_Zdnx4_SME_PNg3_SVE_ADDR_RR_LSL2(LD1W_SME_Zdnx4_SME_PNg3_SVE_ADDR_RR_LSL2),
    LD1W_SME_Ztx2_STRIDED_SME_PNg3_SVE_ADDR_RI_S4x2xVL(LD1W_SME_Ztx2_STRIDED_SME_PNg3_SVE_ADDR_RI_S4x2xVL),
    LD1W_SME_Ztx2_STRIDED_SME_PNg3_SVE_ADDR_RR_LSL2(LD1W_SME_Ztx2_STRIDED_SME_PNg3_SVE_ADDR_RR_LSL2),
    LD1W_SME_Ztx4_STRIDED_SME_PNg3_SVE_ADDR_RI_S4x4xVL(LD1W_SME_Ztx4_STRIDED_SME_PNg3_SVE_ADDR_RI_S4x4xVL),
    LD1W_SME_Ztx4_STRIDED_SME_PNg3_SVE_ADDR_RR_LSL2(LD1W_SME_Ztx4_STRIDED_SME_PNg3_SVE_ADDR_RR_LSL2),
    LD1W_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RI_S4xVL(LD1W_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RI_S4xVL),
    LD1W_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RX_LSL2(LD1W_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RX_LSL2),
    LD1W_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RZ(LD1W_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RZ),
    LD1W_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RZ_LSL2(LD1W_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RZ_LSL2),
    LD1W_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RZ_XTW2_22(LD1W_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RZ_XTW2_22),
    LD1W_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RZ_XTW_22(LD1W_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RZ_XTW_22),
    LD1W_SVE_ZtxN_SVE_Pg3_SVE_ADDR_ZI_U5x4(LD1W_SVE_ZtxN_SVE_Pg3_SVE_ADDR_ZI_U5x4),
    LD1W_SVE_ZtxN_S_D_SVE_Pg3_P_Z_SVE_ADDR_RI_S4xVL(LD1W_SVE_ZtxN_S_D_SVE_Pg3_P_Z_SVE_ADDR_RI_S4xVL),
    LD1W_SVE_ZtxN_S_D_SVE_Pg3_P_Z_SVE_ADDR_RX_LSL2(LD1W_SVE_ZtxN_S_D_SVE_Pg3_P_Z_SVE_ADDR_RX_LSL2),
    LD1W_SVE_ZtxN_S_D_SVE_Pg3_P_Z_SVE_ADDR_RZ_XTW2_22_S_D(LD1W_SVE_ZtxN_S_D_SVE_Pg3_P_Z_SVE_ADDR_RZ_XTW2_22_S_D),
    LD1W_SVE_ZtxN_S_D_SVE_Pg3_P_Z_SVE_ADDR_RZ_XTW_22_S_D(LD1W_SVE_ZtxN_S_D_SVE_Pg3_P_Z_SVE_ADDR_RZ_XTW_22_S_D),
    LD1W_SVE_ZtxN_S_D_SVE_Pg3_P_Z_SVE_ADDR_ZI_U5x4_S_D(LD1W_SVE_ZtxN_S_D_SVE_Pg3_P_Z_SVE_ADDR_ZI_U5x4_S_D),
    LD2B_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RI_S4x2xVL(LD2B_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RI_S4x2xVL),
    LD2B_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RX(LD2B_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RX),
    LD2D_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RI_S4x2xVL(LD2D_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RI_S4x2xVL),
    LD2D_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RX_LSL3(LD2D_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RX_LSL3),
    LD2H_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RI_S4x2xVL(LD2H_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RI_S4x2xVL),
    LD2H_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RX_LSL1(LD2H_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RX_LSL1),
    LD2Q_SME_Zt2_SVE_Pg3_SVE_ADDR_RI_S4x2xVL(LD2Q_SME_Zt2_SVE_Pg3_SVE_ADDR_RI_S4x2xVL),
    LD2Q_SME_Zt2_SVE_Pg3_SVE_ADDR_RR_LSL4(LD2Q_SME_Zt2_SVE_Pg3_SVE_ADDR_RR_LSL4),
    LD2W_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RI_S4x2xVL(LD2W_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RI_S4x2xVL),
    LD2W_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RX_LSL2(LD2W_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RX_LSL2),
    LD3B_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RI_S4x3xVL(LD3B_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RI_S4x3xVL),
    LD3B_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RX(LD3B_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RX),
    LD3D_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RI_S4x3xVL(LD3D_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RI_S4x3xVL),
    LD3D_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RX_LSL3(LD3D_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RX_LSL3),
    LD3H_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RI_S4x3xVL(LD3H_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RI_S4x3xVL),
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    LD3W_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RI_S4x3xVL(LD3W_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RI_S4x3xVL),
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    LD4B_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RX(LD4B_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RX),
    LD4D_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RI_S4x4xVL(LD4D_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RI_S4x4xVL),
    LD4D_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RX_LSL3(LD4D_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RX_LSL3),
    LD4H_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RI_S4x4xVL(LD4H_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RI_S4x4xVL),
    LD4H_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RX_LSL1(LD4H_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RX_LSL1),
    LD4Q_SME_Zt4_SVE_Pg3_SVE_ADDR_RI_S4x2xVL(LD4Q_SME_Zt4_SVE_Pg3_SVE_ADDR_RI_S4x2xVL),
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    LD4W_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RI_S4x4xVL(LD4W_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RI_S4x4xVL),
    LD4W_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RX_LSL2(LD4W_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RX_LSL2),
    LDFF1B_SVE_ZtxN_SVE_Pg3_SVE_ADDR_R(LDFF1B_SVE_ZtxN_SVE_Pg3_SVE_ADDR_R),
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    LDFF1B_SVE_ZtxN_SVE_Pg3_SVE_ADDR_ZI_U5(LDFF1B_SVE_ZtxN_SVE_Pg3_SVE_ADDR_ZI_U5),
    LDFF1B_SVE_ZtxN_S_D_SVE_Pg3_P_Z_SVE_ADDR_R(LDFF1B_SVE_ZtxN_S_D_SVE_Pg3_P_Z_SVE_ADDR_R),
    LDFF1B_SVE_ZtxN_S_D_SVE_Pg3_P_Z_SVE_ADDR_RR(LDFF1B_SVE_ZtxN_S_D_SVE_Pg3_P_Z_SVE_ADDR_RR),
    LDFF1B_SVE_ZtxN_S_D_SVE_Pg3_P_Z_SVE_ADDR_RZ_XTW_22_S_D(LDFF1B_SVE_ZtxN_S_D_SVE_Pg3_P_Z_SVE_ADDR_RZ_XTW_22_S_D),
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    LDFF1B_SVE_ZtxN_S_H_SVE_Pg3_P_Z_SVE_ADDR_R(LDFF1B_SVE_ZtxN_S_H_SVE_Pg3_P_Z_SVE_ADDR_R),
    LDFF1B_SVE_ZtxN_S_H_SVE_Pg3_P_Z_SVE_ADDR_RR(LDFF1B_SVE_ZtxN_S_H_SVE_Pg3_P_Z_SVE_ADDR_RR),
    LDFF1B_SVE_ZtxN_S_S_SVE_Pg3_P_Z_SVE_ADDR_R(LDFF1B_SVE_ZtxN_S_S_SVE_Pg3_P_Z_SVE_ADDR_R),
    LDFF1B_SVE_ZtxN_S_S_SVE_Pg3_P_Z_SVE_ADDR_RR(LDFF1B_SVE_ZtxN_S_S_SVE_Pg3_P_Z_SVE_ADDR_RR),
    LDFF1D_SVE_ZtxN_SVE_Pg3_SVE_ADDR_R(LDFF1D_SVE_ZtxN_SVE_Pg3_SVE_ADDR_R),
    LDFF1D_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RR_LSL3(LDFF1D_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RR_LSL3),
    LDFF1D_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RZ(LDFF1D_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RZ),
    LDFF1D_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RZ_LSL3(LDFF1D_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RZ_LSL3),
    LDFF1D_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RZ_XTW3_22(LDFF1D_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RZ_XTW3_22),
    LDFF1D_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RZ_XTW_22(LDFF1D_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RZ_XTW_22),
    LDFF1D_SVE_ZtxN_SVE_Pg3_SVE_ADDR_ZI_U5x8(LDFF1D_SVE_ZtxN_SVE_Pg3_SVE_ADDR_ZI_U5x8),
    LDFF1H_SVE_ZtxN_SVE_Pg3_SVE_ADDR_R(LDFF1H_SVE_ZtxN_SVE_Pg3_SVE_ADDR_R),
    LDFF1H_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RR_LSL1(LDFF1H_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RR_LSL1),
    LDFF1H_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RZ(LDFF1H_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RZ),
    LDFF1H_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RZ_LSL1(LDFF1H_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RZ_LSL1),
    LDFF1H_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RZ_XTW1_22(LDFF1H_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RZ_XTW1_22),
    LDFF1H_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RZ_XTW_22(LDFF1H_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RZ_XTW_22),
    LDFF1H_SVE_ZtxN_SVE_Pg3_SVE_ADDR_ZI_U5x2(LDFF1H_SVE_ZtxN_SVE_Pg3_SVE_ADDR_ZI_U5x2),
    LDFF1H_SVE_ZtxN_S_D_SVE_Pg3_P_Z_SVE_ADDR_R(LDFF1H_SVE_ZtxN_S_D_SVE_Pg3_P_Z_SVE_ADDR_R),
    LDFF1H_SVE_ZtxN_S_D_SVE_Pg3_P_Z_SVE_ADDR_RR_LSL1(LDFF1H_SVE_ZtxN_S_D_SVE_Pg3_P_Z_SVE_ADDR_RR_LSL1),
    LDFF1H_SVE_ZtxN_S_D_SVE_Pg3_P_Z_SVE_ADDR_RZ_XTW1_22_S_D(LDFF1H_SVE_ZtxN_S_D_SVE_Pg3_P_Z_SVE_ADDR_RZ_XTW1_22_S_D),
    LDFF1H_SVE_ZtxN_S_D_SVE_Pg3_P_Z_SVE_ADDR_RZ_XTW_22_S_D(LDFF1H_SVE_ZtxN_S_D_SVE_Pg3_P_Z_SVE_ADDR_RZ_XTW_22_S_D),
    LDFF1H_SVE_ZtxN_S_D_SVE_Pg3_P_Z_SVE_ADDR_ZI_U5x2_S_D(LDFF1H_SVE_ZtxN_S_D_SVE_Pg3_P_Z_SVE_ADDR_ZI_U5x2_S_D),
    LDFF1H_SVE_ZtxN_S_H_SVE_Pg3_P_Z_SVE_ADDR_R(LDFF1H_SVE_ZtxN_S_H_SVE_Pg3_P_Z_SVE_ADDR_R),
    LDFF1H_SVE_ZtxN_S_H_SVE_Pg3_P_Z_SVE_ADDR_RR_LSL1(LDFF1H_SVE_ZtxN_S_H_SVE_Pg3_P_Z_SVE_ADDR_RR_LSL1),
    LDFF1SB_SVE_ZtxN_SVE_Pg3_SVE_ADDR_R(LDFF1SB_SVE_ZtxN_SVE_Pg3_SVE_ADDR_R),
    LDFF1SB_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RR(LDFF1SB_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RR),
    LDFF1SB_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RZ(LDFF1SB_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RZ),
    LDFF1SB_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RZ_XTW_22(LDFF1SB_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RZ_XTW_22),
    LDFF1SB_SVE_ZtxN_SVE_Pg3_SVE_ADDR_ZI_U5(LDFF1SB_SVE_ZtxN_SVE_Pg3_SVE_ADDR_ZI_U5),
    LDFF1SB_SVE_ZtxN_S_D_SVE_Pg3_P_Z_SVE_ADDR_RZ_XTW_22_S_D(LDFF1SB_SVE_ZtxN_S_D_SVE_Pg3_P_Z_SVE_ADDR_RZ_XTW_22_S_D),
    LDFF1SB_SVE_ZtxN_S_D_SVE_Pg3_P_Z_SVE_ADDR_ZI_U5_S_D(LDFF1SB_SVE_ZtxN_S_D_SVE_Pg3_P_Z_SVE_ADDR_ZI_U5_S_D),
    LDFF1SB_SVE_ZtxN_S_H_SVE_Pg3_P_Z_SVE_ADDR_R(LDFF1SB_SVE_ZtxN_S_H_SVE_Pg3_P_Z_SVE_ADDR_R),
    LDFF1SB_SVE_ZtxN_S_H_SVE_Pg3_P_Z_SVE_ADDR_RR(LDFF1SB_SVE_ZtxN_S_H_SVE_Pg3_P_Z_SVE_ADDR_RR),
    LDFF1SB_SVE_ZtxN_S_S_SVE_Pg3_P_Z_SVE_ADDR_R(LDFF1SB_SVE_ZtxN_S_S_SVE_Pg3_P_Z_SVE_ADDR_R),
    LDFF1SB_SVE_ZtxN_S_S_SVE_Pg3_P_Z_SVE_ADDR_RR(LDFF1SB_SVE_ZtxN_S_S_SVE_Pg3_P_Z_SVE_ADDR_RR),
    LDFF1SH_SVE_ZtxN_SVE_Pg3_SVE_ADDR_R(LDFF1SH_SVE_ZtxN_SVE_Pg3_SVE_ADDR_R),
    LDFF1SH_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RR_LSL1(LDFF1SH_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RR_LSL1),
    LDFF1SH_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RZ(LDFF1SH_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RZ),
    LDFF1SH_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RZ_LSL1(LDFF1SH_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RZ_LSL1),
    LDFF1SH_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RZ_XTW1_22(LDFF1SH_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RZ_XTW1_22),
    LDFF1SH_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RZ_XTW_22(LDFF1SH_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RZ_XTW_22),
    LDFF1SH_SVE_ZtxN_SVE_Pg3_SVE_ADDR_ZI_U5x2(LDFF1SH_SVE_ZtxN_SVE_Pg3_SVE_ADDR_ZI_U5x2),
    LDFF1SH_SVE_ZtxN_S_D_SVE_Pg3_P_Z_SVE_ADDR_RZ_XTW1_22_S_D(LDFF1SH_SVE_ZtxN_S_D_SVE_Pg3_P_Z_SVE_ADDR_RZ_XTW1_22_S_D),
    LDFF1SH_SVE_ZtxN_S_D_SVE_Pg3_P_Z_SVE_ADDR_RZ_XTW_22_S_D(LDFF1SH_SVE_ZtxN_S_D_SVE_Pg3_P_Z_SVE_ADDR_RZ_XTW_22_S_D),
    LDFF1SH_SVE_ZtxN_S_D_SVE_Pg3_P_Z_SVE_ADDR_ZI_U5x2_S_D(LDFF1SH_SVE_ZtxN_S_D_SVE_Pg3_P_Z_SVE_ADDR_ZI_U5x2_S_D),
    LDFF1SH_SVE_ZtxN_S_S_SVE_Pg3_P_Z_SVE_ADDR_R(LDFF1SH_SVE_ZtxN_S_S_SVE_Pg3_P_Z_SVE_ADDR_R),
    LDFF1SH_SVE_ZtxN_S_S_SVE_Pg3_P_Z_SVE_ADDR_RR_LSL1(LDFF1SH_SVE_ZtxN_S_S_SVE_Pg3_P_Z_SVE_ADDR_RR_LSL1),
    LDFF1SW_SVE_ZtxN_SVE_Pg3_SVE_ADDR_R(LDFF1SW_SVE_ZtxN_SVE_Pg3_SVE_ADDR_R),
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    LDFF1SW_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RZ_XTW2_22(LDFF1SW_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RZ_XTW2_22),
    LDFF1SW_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RZ_XTW_22(LDFF1SW_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RZ_XTW_22),
    LDFF1SW_SVE_ZtxN_SVE_Pg3_SVE_ADDR_ZI_U5x4(LDFF1SW_SVE_ZtxN_SVE_Pg3_SVE_ADDR_ZI_U5x4),
    LDFF1W_SVE_ZtxN_SVE_Pg3_SVE_ADDR_R(LDFF1W_SVE_ZtxN_SVE_Pg3_SVE_ADDR_R),
    LDFF1W_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RR_LSL2(LDFF1W_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RR_LSL2),
    LDFF1W_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RZ(LDFF1W_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RZ),
    LDFF1W_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RZ_LSL2(LDFF1W_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RZ_LSL2),
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    LDNF1B_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RI_S4xVL(LDNF1B_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RI_S4xVL),
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    LDR_SVE_PNt_SVE_ADDR_RI_S9xVL(LDR_SVE_PNt_SVE_ADDR_RI_S9xVL),
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    MLA_SVE_Zd_SVE_Zn_SVE_Zm3_INDEX(MLA_SVE_Zd_SVE_Zn_SVE_Zm3_INDEX),
    MLA_SVE_Zd_SVE_Zn_SVE_Zm4_INDEX(MLA_SVE_Zd_SVE_Zn_SVE_Zm4_INDEX),
    MLS_SVE_Zd_SVE_Zn_SVE_Zm3_22_INDEX(MLS_SVE_Zd_SVE_Zn_SVE_Zm3_22_INDEX),
    MLS_SVE_Zd_SVE_Zn_SVE_Zm3_INDEX(MLS_SVE_Zd_SVE_Zn_SVE_Zm3_INDEX),
    MLS_SVE_Zd_SVE_Zn_SVE_Zm4_INDEX(MLS_SVE_Zd_SVE_Zn_SVE_Zm4_INDEX),
    MOVPRFX_SVE_Zd_SVE_Zn(MOVPRFX_SVE_Zd_SVE_Zn),
    MUL_SVE_Zd_SVE_Zn_SVE_Zm3_22_INDEX(MUL_SVE_Zd_SVE_Zn_SVE_Zm3_22_INDEX),
    MUL_SVE_Zd_SVE_Zn_SVE_Zm3_INDEX(MUL_SVE_Zd_SVE_Zn_SVE_Zm3_INDEX),
    MUL_SVE_Zd_SVE_Zn_SVE_Zm4_INDEX(MUL_SVE_Zd_SVE_Zn_SVE_Zm4_INDEX),
    NANDS_SVE_Pd_SVE_Pg4_10_SVE_Pn_SVE_Pm(NANDS_SVE_Pd_SVE_Pg4_10_SVE_Pn_SVE_Pm),
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    NORS_SVE_Pd_SVE_Pg4_10_SVE_Pn_SVE_Pm(NORS_SVE_Pd_SVE_Pg4_10_SVE_Pn_SVE_Pm),
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    ORR_SVE_Zd_SVE_Zn_SVE_Zm_16(ORR_SVE_Zd_SVE_Zn_SVE_Zm_16),
    PFALSE_SVE_PNd(PFALSE_SVE_PNd),
    PFALSE_SVE_Pd(PFALSE_SVE_Pd),
    PFIRST_SVE_Pd_SVE_Pg4_5_SVE_Pd(PFIRST_SVE_Pd_SVE_Pg4_5_SVE_Pd),
    PMULLB_SVE_Zd_SVE_Zn_SVE_Zm_16(PMULLB_SVE_Zd_SVE_Zn_SVE_Zm_16),
    PMULLT_SVE_Zd_SVE_Zn_SVE_Zm_16(PMULLT_SVE_Zd_SVE_Zn_SVE_Zm_16),
    PMUL_SVE_Zd_SVE_Zn_SVE_Zm_16(PMUL_SVE_Zd_SVE_Zn_SVE_Zm_16),
    PRFB_SVE_PRFOP_SVE_Pg3_SVE_ADDR_RI_S6xVL(PRFB_SVE_PRFOP_SVE_Pg3_SVE_ADDR_RI_S6xVL),
    PRFB_SVE_PRFOP_SVE_Pg3_SVE_ADDR_RX(PRFB_SVE_PRFOP_SVE_Pg3_SVE_ADDR_RX),
    PRFB_SVE_PRFOP_SVE_Pg3_SVE_ADDR_RZ(PRFB_SVE_PRFOP_SVE_Pg3_SVE_ADDR_RZ),
    PRFB_SVE_PRFOP_SVE_Pg3_SVE_ADDR_RZ_XTW_22(PRFB_SVE_PRFOP_SVE_Pg3_SVE_ADDR_RZ_XTW_22),
    PRFB_SVE_PRFOP_SVE_Pg3_SVE_ADDR_RZ_XTW_22_c4200000(PRFB_SVE_PRFOP_SVE_Pg3_SVE_ADDR_RZ_XTW_22_c4200000),
    PRFB_SVE_PRFOP_SVE_Pg3_SVE_ADDR_ZI_U5(PRFB_SVE_PRFOP_SVE_Pg3_SVE_ADDR_ZI_U5),
    PRFB_SVE_PRFOP_SVE_Pg3_SVE_ADDR_ZI_U5_c400e000(PRFB_SVE_PRFOP_SVE_Pg3_SVE_ADDR_ZI_U5_c400e000),
    PRFD_SVE_PRFOP_SVE_Pg3_SVE_ADDR_RI_S6xVL(PRFD_SVE_PRFOP_SVE_Pg3_SVE_ADDR_RI_S6xVL),
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    PRFD_SVE_PRFOP_SVE_Pg3_SVE_ADDR_ZI_U5x8_c580e000(PRFD_SVE_PRFOP_SVE_Pg3_SVE_ADDR_ZI_U5x8_c580e000),
    PRFH_SVE_PRFOP_SVE_Pg3_SVE_ADDR_RI_S6xVL(PRFH_SVE_PRFOP_SVE_Pg3_SVE_ADDR_RI_S6xVL),
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    PRFH_SVE_PRFOP_SVE_Pg3_SVE_ADDR_ZI_U5x2_c480e000(PRFH_SVE_PRFOP_SVE_Pg3_SVE_ADDR_ZI_U5x2_c480e000),
    PRFW_SVE_PRFOP_SVE_Pg3_SVE_ADDR_RI_S6xVL(PRFW_SVE_PRFOP_SVE_Pg3_SVE_ADDR_RI_S6xVL),
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    PRFW_SVE_PRFOP_SVE_Pg3_SVE_ADDR_RZ_XTW2_22(PRFW_SVE_PRFOP_SVE_Pg3_SVE_ADDR_RZ_XTW2_22),
    PRFW_SVE_PRFOP_SVE_Pg3_SVE_ADDR_RZ_XTW2_22_c4204000(PRFW_SVE_PRFOP_SVE_Pg3_SVE_ADDR_RZ_XTW2_22_c4204000),
    PRFW_SVE_PRFOP_SVE_Pg3_SVE_ADDR_ZI_U5x4(PRFW_SVE_PRFOP_SVE_Pg3_SVE_ADDR_ZI_U5x4),
    PRFW_SVE_PRFOP_SVE_Pg3_SVE_ADDR_ZI_U5x4_c500e000(PRFW_SVE_PRFOP_SVE_Pg3_SVE_ADDR_ZI_U5x4_c500e000),
    PTEST_SVE_Pg4_10_SVE_Pn(PTEST_SVE_Pg4_10_SVE_Pn),
    PUNPKHI_SVE_Pd_SVE_Pn(PUNPKHI_SVE_Pd_SVE_Pn),
    PUNPKLO_SVE_Pd_SVE_Pn(PUNPKLO_SVE_Pd_SVE_Pn),
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    RDFFRS_SVE_Pd_SVE_Pg4_5(RDFFRS_SVE_Pd_SVE_Pg4_5),
    RDFFR_SVE_Pd(RDFFR_SVE_Pd),
    RDFFR_SVE_Pd_SVE_Pg4_5(RDFFR_SVE_Pd_SVE_Pg4_5),
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    SCVTF_SME_Zdnx2_SME_Znx2(SCVTF_SME_Zdnx2_SME_Znx2),
    SCVTF_SME_Zdnx4_SME_Znx4(SCVTF_SME_Zdnx4_SME_Znx4),
    SCVTF_SVE_Zd_SVE_Pg3_SVE_Zn(SCVTF_SVE_Zd_SVE_Pg3_SVE_Zn),
    SCVTF_SVE_Zd_S_D_SVE_Pg3_P_M_SVE_Zn_S_D(SCVTF_SVE_Zd_S_D_SVE_Pg3_P_M_SVE_Zn_S_D),
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    ST1H_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RZ_XTW_14(ST1H_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RZ_XTW_14),
    ST1H_SVE_ZtxN_SVE_Pg3_SVE_ADDR_ZI_U5x2(ST1H_SVE_ZtxN_SVE_Pg3_SVE_ADDR_ZI_U5x2),
    ST1H_SVE_ZtxN_S_D_SVE_Pg3_SVE_ADDR_RI_S4xVL(ST1H_SVE_ZtxN_S_D_SVE_Pg3_SVE_ADDR_RI_S4xVL),
    ST1H_SVE_ZtxN_S_D_SVE_Pg3_SVE_ADDR_RX_LSL1(ST1H_SVE_ZtxN_S_D_SVE_Pg3_SVE_ADDR_RX_LSL1),
    ST1H_SVE_ZtxN_S_H_SVE_Pg3_SVE_ADDR_RI_S4xVL(ST1H_SVE_ZtxN_S_H_SVE_Pg3_SVE_ADDR_RI_S4xVL),
    ST1H_SVE_ZtxN_S_H_SVE_Pg3_SVE_ADDR_RX_LSL1(ST1H_SVE_ZtxN_S_H_SVE_Pg3_SVE_ADDR_RX_LSL1),
    ST1H_SVE_ZtxN_S_S_SVE_Pg3_SVE_ADDR_RZ_XTW1_14(ST1H_SVE_ZtxN_S_S_SVE_Pg3_SVE_ADDR_RZ_XTW1_14),
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    ST1Q_SVE_Zt_SVE_Pg3_SVE_ADDR_ZX(ST1Q_SVE_Zt_SVE_Pg3_SVE_ADDR_ZX),
    ST1W_SME_ZA_HV_idx_ldstr_SVE_Pg3_SVE_ADDR_R(ST1W_SME_ZA_HV_idx_ldstr_SVE_Pg3_SVE_ADDR_R),
    ST1W_SME_ZA_HV_idx_ldstr_SVE_Pg3_SVE_ADDR_RR_LSL2(ST1W_SME_ZA_HV_idx_ldstr_SVE_Pg3_SVE_ADDR_RR_LSL2),
    ST1W_SME_Zdnx2_SME_PNg3_SVE_ADDR_RI_S4x2xVL(ST1W_SME_Zdnx2_SME_PNg3_SVE_ADDR_RI_S4x2xVL),
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    ST1W_SME_Zdnx4_SME_PNg3_SVE_ADDR_RI_S4x4xVL(ST1W_SME_Zdnx4_SME_PNg3_SVE_ADDR_RI_S4x4xVL),
    ST1W_SME_Zdnx4_SME_PNg3_SVE_ADDR_RR_LSL2(ST1W_SME_Zdnx4_SME_PNg3_SVE_ADDR_RR_LSL2),
    ST1W_SME_Ztx2_STRIDED_SME_PNg3_SVE_ADDR_RI_S4x2xVL(ST1W_SME_Ztx2_STRIDED_SME_PNg3_SVE_ADDR_RI_S4x2xVL),
    ST1W_SME_Ztx2_STRIDED_SME_PNg3_SVE_ADDR_RR_LSL2(ST1W_SME_Ztx2_STRIDED_SME_PNg3_SVE_ADDR_RR_LSL2),
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    ST1W_SME_Ztx4_STRIDED_SME_PNg3_SVE_ADDR_RR_LSL2(ST1W_SME_Ztx4_STRIDED_SME_PNg3_SVE_ADDR_RR_LSL2),
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}

Variants

ADDPL_Rd_SP_SVE_Rn_SP_SVE_SIMM6(ADDPL_Rd_SP_SVE_Rn_SP_SVE_SIMM6)

ADDVL_Rd_SP_SVE_Rn_SP_SVE_SIMM6(ADDVL_Rd_SP_SVE_Rn_SP_SVE_SIMM6)

ADR_SVE_Zd_SVE_ADDR_ZZ_SXTW(ADR_SVE_Zd_SVE_ADDR_ZZ_SXTW)

ADR_SVE_Zd_SVE_ADDR_ZZ_UXTW(ADR_SVE_Zd_SVE_ADDR_ZZ_UXTW)

AESD_SVE_Zd_SVE_Zd_SVE_Zn(AESD_SVE_Zd_SVE_Zd_SVE_Zn)

AESE_SVE_Zd_SVE_Zd_SVE_Zn(AESE_SVE_Zd_SVE_Zd_SVE_Zn)

AESIMC_SVE_Zd_SVE_Zd(AESIMC_SVE_Zd_SVE_Zd)

AESMC_SVE_Zd_SVE_Zd(AESMC_SVE_Zd_SVE_Zd)

ANDS_SVE_Pd_SVE_Pg4_10_SVE_Pn_SVE_Pm(ANDS_SVE_Pd_SVE_Pg4_10_SVE_Pn_SVE_Pm)

AND_SVE_Pd_SVE_Pg4_10_SVE_Pn_SVE_Pm(AND_SVE_Pd_SVE_Pg4_10_SVE_Pn_SVE_Pm)

AND_SVE_Zd_SVE_Zn_SVE_Zm_16(AND_SVE_Zd_SVE_Zn_SVE_Zm_16)

BCAX_SVE_Zd_SVE_Zd_SVE_Zm_16_SVE_Zn(BCAX_SVE_Zd_SVE_Zd_SVE_Zm_16_SVE_Zn)

BFADD_SVE_Zd_SVE_Pg3_SVE_Zd_SVE_Zm_5(BFADD_SVE_Zd_SVE_Pg3_SVE_Zd_SVE_Zm_5)

BFADD_SVE_Zd_SVE_Zn_SVE_Zm_16(BFADD_SVE_Zd_SVE_Zn_SVE_Zm_16)

BFCLAMP_SVE_Zd_SVE_Zn_SVE_Zm_16(BFCLAMP_SVE_Zd_SVE_Zn_SVE_Zm_16)

BFCVTNT_SVE_Zd_SVE_Pg3_SVE_Zn(BFCVTNT_SVE_Zd_SVE_Pg3_SVE_Zn)

BFCVT_SVE_Zd_SVE_Pg3_SVE_Zn(BFCVT_SVE_Zd_SVE_Pg3_SVE_Zn)

BFDOT_SVE_Zd_SVE_Zn_SVE_Zm3_INDEX(BFDOT_SVE_Zd_SVE_Zn_SVE_Zm3_INDEX)

BFDOT_SVE_Zd_SVE_Zn_SVE_Zm_16(BFDOT_SVE_Zd_SVE_Zn_SVE_Zm_16)

BFMAXNM_SVE_Zd_SVE_Pg3_SVE_Zd_SVE_Zm_5(BFMAXNM_SVE_Zd_SVE_Pg3_SVE_Zd_SVE_Zm_5)

BFMAX_SVE_Zd_SVE_Pg3_SVE_Zd_SVE_Zm_5(BFMAX_SVE_Zd_SVE_Pg3_SVE_Zd_SVE_Zm_5)

BFMINNM_SVE_Zd_SVE_Pg3_SVE_Zd_SVE_Zm_5(BFMINNM_SVE_Zd_SVE_Pg3_SVE_Zd_SVE_Zm_5)

BFMIN_SVE_Zd_SVE_Pg3_SVE_Zd_SVE_Zm_5(BFMIN_SVE_Zd_SVE_Pg3_SVE_Zd_SVE_Zm_5)

BFMLALB_SVE_Zd_SVE_Zn_SVE_Zm3_11_INDEX(BFMLALB_SVE_Zd_SVE_Zn_SVE_Zm3_11_INDEX)

BFMLALB_SVE_Zd_SVE_Zn_SVE_Zm_16(BFMLALB_SVE_Zd_SVE_Zn_SVE_Zm_16)

BFMLALT_SVE_Zd_SVE_Zn_SVE_Zm3_11_INDEX(BFMLALT_SVE_Zd_SVE_Zn_SVE_Zm3_11_INDEX)

BFMLALT_SVE_Zd_SVE_Zn_SVE_Zm_16(BFMLALT_SVE_Zd_SVE_Zn_SVE_Zm_16)

BFMLA_SVE_Zd_SVE_Pg3_SVE_Zn_SVE_Zm_16(BFMLA_SVE_Zd_SVE_Pg3_SVE_Zn_SVE_Zm_16)

BFMLA_SVE_Zd_SVE_Zn_SVE_Zm3_11_INDEX(BFMLA_SVE_Zd_SVE_Zn_SVE_Zm3_11_INDEX)

BFMLSLB_SVE_Zd_SVE_Zn_SVE_Zm3_11_INDEX(BFMLSLB_SVE_Zd_SVE_Zn_SVE_Zm3_11_INDEX)

BFMLSLB_SVE_Zd_SVE_Zn_SVE_Zm_16(BFMLSLB_SVE_Zd_SVE_Zn_SVE_Zm_16)

BFMLSLT_SVE_Zd_SVE_Zn_SVE_Zm3_11_INDEX(BFMLSLT_SVE_Zd_SVE_Zn_SVE_Zm3_11_INDEX)

BFMLSLT_SVE_Zd_SVE_Zn_SVE_Zm_16(BFMLSLT_SVE_Zd_SVE_Zn_SVE_Zm_16)

BFMLS_SVE_Zd_SVE_Pg3_SVE_Zn_SVE_Zm_16(BFMLS_SVE_Zd_SVE_Pg3_SVE_Zn_SVE_Zm_16)

BFMLS_SVE_Zd_SVE_Zn_SVE_Zm3_11_INDEX(BFMLS_SVE_Zd_SVE_Zn_SVE_Zm3_11_INDEX)

BFMMLA_SVE_Zd_SVE_Zn_SVE_Zm_16(BFMMLA_SVE_Zd_SVE_Zn_SVE_Zm_16)

BFMUL_SVE_Zd_SVE_Pg3_SVE_Zd_SVE_Zm_5(BFMUL_SVE_Zd_SVE_Pg3_SVE_Zd_SVE_Zm_5)

BFMUL_SVE_Zd_SVE_Zn_SVE_Zm3_11_INDEX(BFMUL_SVE_Zd_SVE_Zn_SVE_Zm3_11_INDEX)

BFMUL_SVE_Zd_SVE_Zn_SVE_Zm_16(BFMUL_SVE_Zd_SVE_Zn_SVE_Zm_16)

BFSUB_SVE_Zd_SVE_Pg3_SVE_Zd_SVE_Zm_5(BFSUB_SVE_Zd_SVE_Pg3_SVE_Zd_SVE_Zm_5)

BFSUB_SVE_Zd_SVE_Zn_SVE_Zm_16(BFSUB_SVE_Zd_SVE_Zn_SVE_Zm_16)

BICS_SVE_Pd_SVE_Pg4_10_SVE_Pn_SVE_Pm(BICS_SVE_Pd_SVE_Pg4_10_SVE_Pn_SVE_Pm)

BIC_SVE_Pd_SVE_Pg4_10_SVE_Pn_SVE_Pm(BIC_SVE_Pd_SVE_Pg4_10_SVE_Pn_SVE_Pm)

BIC_SVE_Zd_SVE_Zn_SVE_Zm_16(BIC_SVE_Zd_SVE_Zn_SVE_Zm_16)

BRKAS_SVE_Pd_SVE_Pg4_10_SVE_Pn(BRKAS_SVE_Pd_SVE_Pg4_10_SVE_Pn)

BRKBS_SVE_Pd_SVE_Pg4_10_SVE_Pn(BRKBS_SVE_Pd_SVE_Pg4_10_SVE_Pn)

BRKNS_SVE_Pd_SVE_Pg4_10_SVE_Pn_SVE_Pd(BRKNS_SVE_Pd_SVE_Pg4_10_SVE_Pn_SVE_Pd)

BRKN_SVE_Pd_SVE_Pg4_10_SVE_Pn_SVE_Pd(BRKN_SVE_Pd_SVE_Pg4_10_SVE_Pn_SVE_Pd)

BRKPAS_SVE_Pd_SVE_Pg4_10_SVE_Pn_SVE_Pm(BRKPAS_SVE_Pd_SVE_Pg4_10_SVE_Pn_SVE_Pm)

BRKPA_SVE_Pd_SVE_Pg4_10_SVE_Pn_SVE_Pm(BRKPA_SVE_Pd_SVE_Pg4_10_SVE_Pn_SVE_Pm)

BRKPBS_SVE_Pd_SVE_Pg4_10_SVE_Pn_SVE_Pm(BRKPBS_SVE_Pd_SVE_Pg4_10_SVE_Pn_SVE_Pm)

BRKPB_SVE_Pd_SVE_Pg4_10_SVE_Pn_SVE_Pm(BRKPB_SVE_Pd_SVE_Pg4_10_SVE_Pn_SVE_Pm)

BSL1N_SVE_Zd_SVE_Zd_SVE_Zm_16_SVE_Zn(BSL1N_SVE_Zd_SVE_Zd_SVE_Zm_16_SVE_Zn)

BSL2N_SVE_Zd_SVE_Zd_SVE_Zm_16_SVE_Zn(BSL2N_SVE_Zd_SVE_Zd_SVE_Zm_16_SVE_Zn)

BSL_SVE_Zd_SVE_Zd_SVE_Zm_16_SVE_Zn(BSL_SVE_Zd_SVE_Zd_SVE_Zm_16_SVE_Zn)

CDOT_SVE_Zd_SVE_Zn_SVE_Zm3_INDEX_SVE_IMM_ROT2(CDOT_SVE_Zd_SVE_Zn_SVE_Zm3_INDEX_SVE_IMM_ROT2)

CDOT_SVE_Zd_SVE_Zn_SVE_Zm4_INDEX_SVE_IMM_ROT2(CDOT_SVE_Zd_SVE_Zn_SVE_Zm4_INDEX_SVE_IMM_ROT2)

CMLA_SVE_Zd_SVE_Zn_SVE_Zm3_INDEX_SVE_IMM_ROT2(CMLA_SVE_Zd_SVE_Zn_SVE_Zm3_INDEX_SVE_IMM_ROT2)

CMLA_SVE_Zd_SVE_Zn_SVE_Zm4_INDEX_SVE_IMM_ROT2(CMLA_SVE_Zd_SVE_Zn_SVE_Zm4_INDEX_SVE_IMM_ROT2)

CNTB_Rd_SVE_PATTERN_SCALED(CNTB_Rd_SVE_PATTERN_SCALED)

CNTD_Rd_SVE_PATTERN_SCALED(CNTD_Rd_SVE_PATTERN_SCALED)

CNTH_Rd_SVE_PATTERN_SCALED(CNTH_Rd_SVE_PATTERN_SCALED)

CNTW_Rd_SVE_PATTERN_SCALED(CNTW_Rd_SVE_PATTERN_SCALED)

DECB_Rd_SVE_PATTERN_SCALED(DECB_Rd_SVE_PATTERN_SCALED)

DECD_Rd_SVE_PATTERN_SCALED(DECD_Rd_SVE_PATTERN_SCALED)

DECD_SVE_Zd_SVE_PATTERN_SCALED(DECD_SVE_Zd_SVE_PATTERN_SCALED)

DECH_Rd_SVE_PATTERN_SCALED(DECH_Rd_SVE_PATTERN_SCALED)

DECH_SVE_Zd_SVE_PATTERN_SCALED(DECH_SVE_Zd_SVE_PATTERN_SCALED)

DECW_Rd_SVE_PATTERN_SCALED(DECW_Rd_SVE_PATTERN_SCALED)

DECW_SVE_Zd_SVE_PATTERN_SCALED(DECW_SVE_Zd_SVE_PATTERN_SCALED)

EOR3_SVE_Zd_SVE_Zd_SVE_Zm_16_SVE_Zn(EOR3_SVE_Zd_SVE_Zd_SVE_Zm_16_SVE_Zn)

EORS_SVE_Pd_SVE_Pg4_10_SVE_Pn_SVE_Pm(EORS_SVE_Pd_SVE_Pg4_10_SVE_Pn_SVE_Pm)

EOR_SVE_Pd_SVE_Pg4_10_SVE_Pn_SVE_Pm(EOR_SVE_Pd_SVE_Pg4_10_SVE_Pn_SVE_Pm)

EOR_SVE_Zd_SVE_Zn_SVE_Zm_16(EOR_SVE_Zd_SVE_Zn_SVE_Zm_16)

EXTQ_SVE_Zd_SVE_Zd_SVE_Zm_imm4(EXTQ_SVE_Zd_SVE_Zd_SVE_Zm_imm4)

EXT_SVE_Zd_SVE_Zd_SVE_Zm_5_SVE_UIMM8_53(EXT_SVE_Zd_SVE_Zd_SVE_Zm_5_SVE_UIMM8_53)

EXT_SVE_Zd_SVE_ZnxN_SVE_UIMM8_53(EXT_SVE_Zd_SVE_ZnxN_SVE_UIMM8_53)

FCMLA_SVE_Zd_SVE_Zn_SVE_Zm3_INDEX_SVE_IMM_ROT2(FCMLA_SVE_Zd_SVE_Zn_SVE_Zm3_INDEX_SVE_IMM_ROT2)

FCMLA_SVE_Zd_SVE_Zn_SVE_Zm4_INDEX_SVE_IMM_ROT2(FCMLA_SVE_Zd_SVE_Zn_SVE_Zm4_INDEX_SVE_IMM_ROT2)

FCVTLT_SVE_Zd_SVE_Pg3_SVE_Zn(FCVTLT_SVE_Zd_SVE_Pg3_SVE_Zn)

FCVTLT_SVE_Zd_S_D_SVE_Pg3_P_M_SVE_Zn_S_S(FCVTLT_SVE_Zd_S_D_SVE_Pg3_P_M_SVE_Zn_S_S)

FCVTNT_SVE_Zd_SVE_Pg3_SVE_Zn(FCVTNT_SVE_Zd_SVE_Pg3_SVE_Zn)

FCVTNT_SVE_Zd_S_S_SVE_Pg3_P_M_SVE_Zn_S_D(FCVTNT_SVE_Zd_S_S_SVE_Pg3_P_M_SVE_Zn_S_D)

FCVTN_SVE_Zd_SME_Znx2(FCVTN_SVE_Zd_SME_Znx2)

FCVTXNT_SVE_Zd_SVE_Pg3_SVE_Zn(FCVTXNT_SVE_Zd_SVE_Pg3_SVE_Zn)

FCVTX_SVE_Zd_SVE_Pg3_SVE_Zn(FCVTX_SVE_Zd_SVE_Pg3_SVE_Zn)

FCVTZS_SME_Zdnx2_SME_Znx2(FCVTZS_SME_Zdnx2_SME_Znx2)

FCVTZS_SME_Zdnx4_SME_Znx4(FCVTZS_SME_Zdnx4_SME_Znx4)

FCVTZS_SVE_Zd_SVE_Pg3_SVE_Zn(FCVTZS_SVE_Zd_SVE_Pg3_SVE_Zn)

FCVTZS_SVE_Zd_S_D_SVE_Pg3_P_M_SVE_Zn_S_D(FCVTZS_SVE_Zd_S_D_SVE_Pg3_P_M_SVE_Zn_S_D)

FCVTZS_SVE_Zd_S_D_SVE_Pg3_P_M_SVE_Zn_S_H(FCVTZS_SVE_Zd_S_D_SVE_Pg3_P_M_SVE_Zn_S_H)

FCVTZS_SVE_Zd_S_D_SVE_Pg3_P_M_SVE_Zn_S_S(FCVTZS_SVE_Zd_S_D_SVE_Pg3_P_M_SVE_Zn_S_S)

FCVTZS_SVE_Zd_S_H_SVE_Pg3_P_M_SVE_Zn_S_H(FCVTZS_SVE_Zd_S_H_SVE_Pg3_P_M_SVE_Zn_S_H)

FCVTZS_SVE_Zd_S_S_SVE_Pg3_P_M_SVE_Zn_S_D(FCVTZS_SVE_Zd_S_S_SVE_Pg3_P_M_SVE_Zn_S_D)

FCVTZS_SVE_Zd_S_S_SVE_Pg3_P_M_SVE_Zn_S_H(FCVTZS_SVE_Zd_S_S_SVE_Pg3_P_M_SVE_Zn_S_H)

FCVTZU_SME_Zdnx2_SME_Znx2(FCVTZU_SME_Zdnx2_SME_Znx2)

FCVTZU_SME_Zdnx4_SME_Znx4(FCVTZU_SME_Zdnx4_SME_Znx4)

FCVTZU_SVE_Zd_SVE_Pg3_SVE_Zn(FCVTZU_SVE_Zd_SVE_Pg3_SVE_Zn)

FCVTZU_SVE_Zd_S_D_SVE_Pg3_P_M_SVE_Zn_S_D(FCVTZU_SVE_Zd_S_D_SVE_Pg3_P_M_SVE_Zn_S_D)

FCVTZU_SVE_Zd_S_D_SVE_Pg3_P_M_SVE_Zn_S_H(FCVTZU_SVE_Zd_S_D_SVE_Pg3_P_M_SVE_Zn_S_H)

FCVTZU_SVE_Zd_S_D_SVE_Pg3_P_M_SVE_Zn_S_S(FCVTZU_SVE_Zd_S_D_SVE_Pg3_P_M_SVE_Zn_S_S)

FCVTZU_SVE_Zd_S_H_SVE_Pg3_P_M_SVE_Zn_S_H(FCVTZU_SVE_Zd_S_H_SVE_Pg3_P_M_SVE_Zn_S_H)

FCVTZU_SVE_Zd_S_S_SVE_Pg3_P_M_SVE_Zn_S_H(FCVTZU_SVE_Zd_S_S_SVE_Pg3_P_M_SVE_Zn_S_H)

FCVTZU_SVE_Zd_S_S_SVE_Pg3_P_M_SVE_Zn_S_S(FCVTZU_SVE_Zd_S_S_SVE_Pg3_P_M_SVE_Zn_S_S)

FCVT_SVE_Zd_SME_Znx2(FCVT_SVE_Zd_SME_Znx2)

FCVT_SVE_Zd_SVE_Pg3_SVE_Zn(FCVT_SVE_Zd_SVE_Pg3_SVE_Zn)

FCVT_SVE_Zd_S_D_SVE_Pg3_P_M_SVE_Zn_S_H(FCVT_SVE_Zd_S_D_SVE_Pg3_P_M_SVE_Zn_S_H)

FCVT_SVE_Zd_S_D_SVE_Pg3_P_M_SVE_Zn_S_S(FCVT_SVE_Zd_S_D_SVE_Pg3_P_M_SVE_Zn_S_S)

FCVT_SVE_Zd_S_H_SVE_Pg3_P_M_SVE_Zn_S_D(FCVT_SVE_Zd_S_H_SVE_Pg3_P_M_SVE_Zn_S_D)

FCVT_SVE_Zd_S_S_SVE_Pg3_P_M_SVE_Zn_S_D(FCVT_SVE_Zd_S_S_SVE_Pg3_P_M_SVE_Zn_S_D)

FCVT_SVE_Zd_S_S_SVE_Pg3_P_M_SVE_Zn_S_H(FCVT_SVE_Zd_S_S_SVE_Pg3_P_M_SVE_Zn_S_H)

FDOT_SVE_Zd_SVE_Zn_SVE_Zm3_19_INDEX(FDOT_SVE_Zd_SVE_Zn_SVE_Zm3_19_INDEX)

FDOT_SVE_Zd_SVE_Zn_SVE_Zm_16(FDOT_SVE_Zd_SVE_Zn_SVE_Zm_16)

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LDNT1W_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RI_S4xVL(LDNT1W_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RI_S4xVL)

LDNT1W_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RX_LSL2(LDNT1W_SVE_ZtxN_SVE_Pg3_SVE_ADDR_RX_LSL2)

LDNT1W_SVE_ZtxN_SVE_Pg3_SVE_ADDR_ZX(LDNT1W_SVE_ZtxN_SVE_Pg3_SVE_ADDR_ZX)

LDNT1W_SVE_ZtxN_S_D_SVE_Pg3_P_Z_SVE_ADDR_ZX_S_D(LDNT1W_SVE_ZtxN_S_D_SVE_Pg3_P_Z_SVE_ADDR_ZX_S_D)

LDR_SVE_PNt_SVE_ADDR_RI_S9xVL(LDR_SVE_PNt_SVE_ADDR_RI_S9xVL)

LDR_SVE_Pt_SVE_ADDR_RI_S9xVL(LDR_SVE_Pt_SVE_ADDR_RI_S9xVL)

LDR_SVE_Zt_SVE_ADDR_RI_S9xVL(LDR_SVE_Zt_SVE_ADDR_RI_S9xVL)

MLA_SVE_Zd_SVE_Zn_SVE_Zm3_22_INDEX(MLA_SVE_Zd_SVE_Zn_SVE_Zm3_22_INDEX)

MLA_SVE_Zd_SVE_Zn_SVE_Zm3_INDEX(MLA_SVE_Zd_SVE_Zn_SVE_Zm3_INDEX)

MLA_SVE_Zd_SVE_Zn_SVE_Zm4_INDEX(MLA_SVE_Zd_SVE_Zn_SVE_Zm4_INDEX)

MLS_SVE_Zd_SVE_Zn_SVE_Zm3_22_INDEX(MLS_SVE_Zd_SVE_Zn_SVE_Zm3_22_INDEX)

MLS_SVE_Zd_SVE_Zn_SVE_Zm3_INDEX(MLS_SVE_Zd_SVE_Zn_SVE_Zm3_INDEX)

MLS_SVE_Zd_SVE_Zn_SVE_Zm4_INDEX(MLS_SVE_Zd_SVE_Zn_SVE_Zm4_INDEX)

MOVPRFX_SVE_Zd_SVE_Zn(MOVPRFX_SVE_Zd_SVE_Zn)

MUL_SVE_Zd_SVE_Zn_SVE_Zm3_22_INDEX(MUL_SVE_Zd_SVE_Zn_SVE_Zm3_22_INDEX)

MUL_SVE_Zd_SVE_Zn_SVE_Zm3_INDEX(MUL_SVE_Zd_SVE_Zn_SVE_Zm3_INDEX)

MUL_SVE_Zd_SVE_Zn_SVE_Zm4_INDEX(MUL_SVE_Zd_SVE_Zn_SVE_Zm4_INDEX)

NANDS_SVE_Pd_SVE_Pg4_10_SVE_Pn_SVE_Pm(NANDS_SVE_Pd_SVE_Pg4_10_SVE_Pn_SVE_Pm)

NAND_SVE_Pd_SVE_Pg4_10_SVE_Pn_SVE_Pm(NAND_SVE_Pd_SVE_Pg4_10_SVE_Pn_SVE_Pm)

NBSL_SVE_Zd_SVE_Zd_SVE_Zm_16_SVE_Zn(NBSL_SVE_Zd_SVE_Zd_SVE_Zm_16_SVE_Zn)

NORS_SVE_Pd_SVE_Pg4_10_SVE_Pn_SVE_Pm(NORS_SVE_Pd_SVE_Pg4_10_SVE_Pn_SVE_Pm)

NOR_SVE_Pd_SVE_Pg4_10_SVE_Pn_SVE_Pm(NOR_SVE_Pd_SVE_Pg4_10_SVE_Pn_SVE_Pm)

ORNS_SVE_Pd_SVE_Pg4_10_SVE_Pn_SVE_Pm(ORNS_SVE_Pd_SVE_Pg4_10_SVE_Pn_SVE_Pm)

ORN_SVE_Pd_SVE_Pg4_10_SVE_Pn_SVE_Pm(ORN_SVE_Pd_SVE_Pg4_10_SVE_Pn_SVE_Pm)

ORRS_SVE_Pd_SVE_Pg4_10_SVE_Pn_SVE_Pm(ORRS_SVE_Pd_SVE_Pg4_10_SVE_Pn_SVE_Pm)

ORR_SVE_Pd_SVE_Pg4_10_SVE_Pn_SVE_Pm(ORR_SVE_Pd_SVE_Pg4_10_SVE_Pn_SVE_Pm)

ORR_SVE_Zd_SVE_Zn_SVE_Zm_16(ORR_SVE_Zd_SVE_Zn_SVE_Zm_16)

PFALSE_SVE_PNd(PFALSE_SVE_PNd)

PFALSE_SVE_Pd(PFALSE_SVE_Pd)

PFIRST_SVE_Pd_SVE_Pg4_5_SVE_Pd(PFIRST_SVE_Pd_SVE_Pg4_5_SVE_Pd)

PMULLB_SVE_Zd_SVE_Zn_SVE_Zm_16(PMULLB_SVE_Zd_SVE_Zn_SVE_Zm_16)

PMULLT_SVE_Zd_SVE_Zn_SVE_Zm_16(PMULLT_SVE_Zd_SVE_Zn_SVE_Zm_16)

PMUL_SVE_Zd_SVE_Zn_SVE_Zm_16(PMUL_SVE_Zd_SVE_Zn_SVE_Zm_16)

PRFB_SVE_PRFOP_SVE_Pg3_SVE_ADDR_RI_S6xVL(PRFB_SVE_PRFOP_SVE_Pg3_SVE_ADDR_RI_S6xVL)

PRFB_SVE_PRFOP_SVE_Pg3_SVE_ADDR_RX(PRFB_SVE_PRFOP_SVE_Pg3_SVE_ADDR_RX)

PRFB_SVE_PRFOP_SVE_Pg3_SVE_ADDR_RZ(PRFB_SVE_PRFOP_SVE_Pg3_SVE_ADDR_RZ)

PRFB_SVE_PRFOP_SVE_Pg3_SVE_ADDR_RZ_XTW_22(PRFB_SVE_PRFOP_SVE_Pg3_SVE_ADDR_RZ_XTW_22)

PRFB_SVE_PRFOP_SVE_Pg3_SVE_ADDR_RZ_XTW_22_c4200000(PRFB_SVE_PRFOP_SVE_Pg3_SVE_ADDR_RZ_XTW_22_c4200000)

PRFB_SVE_PRFOP_SVE_Pg3_SVE_ADDR_ZI_U5(PRFB_SVE_PRFOP_SVE_Pg3_SVE_ADDR_ZI_U5)

PRFB_SVE_PRFOP_SVE_Pg3_SVE_ADDR_ZI_U5_c400e000(PRFB_SVE_PRFOP_SVE_Pg3_SVE_ADDR_ZI_U5_c400e000)

PRFD_SVE_PRFOP_SVE_Pg3_SVE_ADDR_RI_S6xVL(PRFD_SVE_PRFOP_SVE_Pg3_SVE_ADDR_RI_S6xVL)

PRFD_SVE_PRFOP_SVE_Pg3_SVE_ADDR_RX_LSL3(PRFD_SVE_PRFOP_SVE_Pg3_SVE_ADDR_RX_LSL3)

PRFD_SVE_PRFOP_SVE_Pg3_SVE_ADDR_RZ_LSL3(PRFD_SVE_PRFOP_SVE_Pg3_SVE_ADDR_RZ_LSL3)

PRFD_SVE_PRFOP_SVE_Pg3_SVE_ADDR_RZ_XTW3_22(PRFD_SVE_PRFOP_SVE_Pg3_SVE_ADDR_RZ_XTW3_22)

PRFD_SVE_PRFOP_SVE_Pg3_SVE_ADDR_RZ_XTW3_22_c4206000(PRFD_SVE_PRFOP_SVE_Pg3_SVE_ADDR_RZ_XTW3_22_c4206000)

PRFD_SVE_PRFOP_SVE_Pg3_SVE_ADDR_ZI_U5x8(PRFD_SVE_PRFOP_SVE_Pg3_SVE_ADDR_ZI_U5x8)

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PUNPKHI_SVE_Pd_SVE_Pn(PUNPKHI_SVE_Pd_SVE_Pn)

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WRFFR_SVE_Pn(WRFFR_SVE_Pn)

ZIP1_SVE_Zd_SVE_Zn_SVE_Zm_16(ZIP1_SVE_Zd_SVE_Zn_SVE_Zm_16)

ZIP2_SVE_Zd_SVE_Zn_SVE_Zm_16(ZIP2_SVE_Zd_SVE_Zn_SVE_Zm_16)

Trait Implementations

impl Clone for SVE_MISC

fn clone(&self) -> SVE_MISC

Returns a duplicate of the value.

fn clone_from(&mut self, source: &Self)

Performs copy-assignment from source.

impl Debug for SVE_MISC

fn fmt(&self, f: &mut Formatter<'_>) -> Result

Formats the value using the given formatter.

impl InsnOpcode for SVE_MISC

fn definition(&self) -> &'static Insn

fn bits(&self) -> u32

impl PartialEq for SVE_MISC

fn eq(&self, other: &SVE_MISC) -> bool

Tests for self and other values to be equal, and is used by ==.

fn ne(&self, other: &Rhs) -> bool

Tests for !=. The default implementation is almost always sufficient, and should not be overridden without very good reason.

impl Copy for SVE_MISC

impl Eq for SVE_MISC

impl StructuralPartialEq for SVE_MISC