Enum capstone_sys::riscv_insn [−][src]
#[repr(u32)]
pub enum riscv_insn {
Show variants
RISCV_INS_INVALID,
RISCV_INS_ADD,
RISCV_INS_ADDI,
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RISCV_INS_DIVW,
RISCV_INS_EBREAK,
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RISCV_INS_FCLASS_S,
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RISCV_INS_FCVT_L_D,
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RISCV_INS_FCVT_S_L,
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RISCV_INS_FCVT_WU_S,
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RISCV_INS_FSGNJ_S,
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RISCV_INS_JAL,
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RISCV_INS_SC_D_RL,
RISCV_INS_SC_W,
RISCV_INS_SC_W_AQ,
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RISCV_INS_SC_W_RL,
RISCV_INS_SD,
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RISCV_INS_SH,
RISCV_INS_SLL,
RISCV_INS_SLLI,
RISCV_INS_SLLIW,
RISCV_INS_SLLW,
RISCV_INS_SLT,
RISCV_INS_SLTI,
RISCV_INS_SLTIU,
RISCV_INS_SLTU,
RISCV_INS_SRA,
RISCV_INS_SRAI,
RISCV_INS_SRAIW,
RISCV_INS_SRAW,
RISCV_INS_SRET,
RISCV_INS_SRL,
RISCV_INS_SRLI,
RISCV_INS_SRLIW,
RISCV_INS_SRLW,
RISCV_INS_SUB,
RISCV_INS_SUBW,
RISCV_INS_SW,
RISCV_INS_UNIMP,
RISCV_INS_URET,
RISCV_INS_WFI,
RISCV_INS_XOR,
RISCV_INS_XORI,
RISCV_INS_ENDING,
}Variants
Trait Implementations
impl From<u32> for riscv_insn
impl From<u32> for riscv_insnfn from(id: u32) -> Self
fn from(id: u32) -> SelfPerforms the conversion.