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Structs

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• Mailbox
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• batch::ConfiguredTransfer
• batch::Transfer
• dma::Channel0
• dma::Channel1
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• platform::Platform
• smi::Control
• smi::Controller
• smi::Device0
• smi::Device1
• smi::Device2
• smi::Device3
• smi::Devices
• smi::Peripheral
• smi::ReadSettings
• smi::WriteSettings

Enums

• gpio::Mode
• smi::ClockSource
• smi::TransferDir
• smi::TransferWidth

Traits

• dma::Channel
• gpio::Pin
• smi::Device

Functions

• map_phys_to_virt
• unmap_phys_to_virt

Constants

• MEM_FLAG_COHERENT
• MEM_FLAG_DIRECT
• MEM_FLAG_DISCARDABLE
• MEM_FLAG_HINT_PERMALOCK
• MEM_FLAG_L1_NONALLOCATING
• MEM_FLAG_NORMAL
• MEM_FLAG_NO_INIT
• MEM_FLAG_ZERO
• dma::DMA_CB_DEST_AD
• dma::DMA_CB_NEXTCONBK
• dma::DMA_CB_SOURCE_AD
• dma::DMA_CB_STRIDE
• dma::DMA_CB_TI
• dma::DMA_CB_TXFR_LEN
• dma::DMA_CHANNEL_OFFSET
• dma::DMA_CONBLK_AD
• dma::DMA_CONTROL_BLOCK_SIZE
• dma::DMA_CS
• dma::DMA_CS_ABORT
• dma::DMA_CS_ACTIVE
• dma::DMA_CS_DISDEBUG
• dma::DMA_CS_DREQ
• dma::DMA_CS_DREQ_STOPS_DMA
• dma::DMA_CS_END
• dma::DMA_CS_ERROR
• dma::DMA_CS_INT
• dma::DMA_CS_PANIC_PRIORITY
• dma::DMA_CS_PAUSED
• dma::DMA_CS_PRIORITY
• dma::DMA_CS_RESET
• dma::DMA_CS_WAITING_FOR_OUTSTANDING_WRITES
• dma::DMA_CS_WAIT_FOR_OUTSTANDING_WRITES
• dma::DMA_DEBUG
• dma::DMA_DEBUG_DMA_ID
• dma::DMA_ENABLE_OFFSET
• dma::DMA_OFFSET
• dma::DMA_PERMAP_BSC_SPI_SLAVE_RX
• dma::DMA_PERMAP_BSC_SPI_SLAVE_TX
• dma::DMA_PERMAP_DSI1
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• dma::DMA_PERMAP_E_MMC
• dma::DMA_PERMAP_HDMI
• dma::DMA_PERMAP_PCM_RX
• dma::DMA_PERMAP_PCM_TX
• dma::DMA_PERMAP_PWM
• dma::DMA_PERMAP_SCALER_FIFO_0_AND_SMI
• dma::DMA_PERMAP_SCALER_FIFO_1_AND_SMI
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• dma::DMA_PERMAP_SD_HOST
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• dma::DMA_PERMAP_SLIMBUS_MCRX
• dma::DMA_PERMAP_SLIMBUS_MCTX
• dma::DMA_PERMAP_SMI
• dma::DMA_PERMAP_SPI_RX
• dma::DMA_PERMAP_SPI_TX
• dma::DMA_PERMAP_UART_RX
• dma::DMA_PERMAP_UART_TX
• dma::DMA_TI_BURST_LENGTH
• dma::DMA_TI_DEST_DREQ
• dma::DMA_TI_DEST_IGNORE
• dma::DMA_TI_DEST_INC
• dma::DMA_TI_DEST_WIDTH
• dma::DMA_TI_INTEN
• dma::DMA_TI_NO_WIDE_BURSTS
• dma::DMA_TI_PERMAP
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• dma::DMA_TI_SRC_WIDTH
• dma::DMA_TI_TDMODE
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• dma::DMA_TI_WAIT_RESP
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