[][src]Module cc3220sf::hib3p3

HIB3P3

Modules

hib_1p8v_det_en

HIB_1P8V_DET_EN

hib_1p2_1p8_ldo_trim

HIB_1P2_1P8_LDO_TRIM

hib_comp_trim

HIB_COMP_TRIM

hib_en_ts

HIB_EN_TS

hib_nhib_enable

HIB_NHIB_ENABLE

hib_tmux_ctrl

HIB_TMUX_CTRL

hib_uart_rts_sw_enable

HIB_UART_RTS_SW_ENABLE

hib_vbat_mon_en

HIB_VBAT_MON_EN

hibana_spare_lowv

HIBANA_SPARE_LOWV

mem_bgap_parameters0

MEM_BGAP_PARAMETERS0

mem_bgap_parameters1

MEM_BGAP_PARAMETERS1

mem_gpio_wake_conf

MEM_GPIO_WAKE_CONF

mem_gpio_wake_en

MEM_GPIO_WAKE_EN

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MEM_HIB_CONFIG

mem_hib_detection_status

MEM_HIB_DETECTION_STATUS

mem_hib_lpds_gpio_sel

MEM_HIB_LPDS_GPIO_SEL

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MEM_HIB_MISC_CONFIG

mem_hib_misc_controls

MEM_HIB_MISC_CONTROLS

mem_hib_reg0

MEM_HIB_REG0

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MEM_HIB_REG1

mem_hib_reg2

MEM_HIB_REG2

mem_hib_reg3

MEM_HIB_REG3

mem_hib_req

MEM_HIB_REQ

mem_hib_rtc_irq_enable

MEM_HIB_RTC_IRQ_ENABLE

mem_hib_rtc_irq_lsw_conf

MEM_HIB_RTC_IRQ_LSW_CONF

mem_hib_rtc_irq_msw_conf

MEM_HIB_RTC_IRQ_MSW_CONF

mem_hib_rtc_timer_enable

MEM_HIB_RTC_TIMER_ENABLE

mem_hib_rtc_timer_lsw

MEM_HIB_RTC_TIMER_LSW

mem_hib_rtc_timer_msw

MEM_HIB_RTC_TIMER_MSW

mem_hib_rtc_timer_read

MEM_HIB_RTC_TIMER_READ

mem_hib_rtc_timer_reset

MEM_HIB_RTC_TIMER_RESET

mem_hib_rtc_wake_en

MEM_HIB_RTC_WAKE_EN

mem_hib_rtc_wake_lsw_conf

MEM_HIB_RTC_WAKE_LSW_CONF

mem_hib_rtc_wake_msw_conf

MEM_HIB_RTC_WAKE_MSW_CONF

mem_hib_sequencer_cfg0

MEM_HIB_SEQUENCER_CFG0

mem_hib_sequencer_cfg1

MEM_HIB_SEQUENCER_CFG1

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MEM_HIB_SEQUENCER_CFG2

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MEM_HIB_UART_CONF

mem_hib_wake_status

MEM_HIB_WAKE_STATUS

mem_int_osc_conf

MEM_INT_OSC_CONF

mem_jtag_conf

MEM_JTAG_CONF

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MEM_PAD_OEN_RET33_CONF

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MEM_UART_RTS_OEN_RET33_CONF

mem_xtal_osc_conf

MEM_XTAL_OSC_CONF

Structs

RegisterBlock

Register block

Type Definitions

HIBANA_SPARE_LOWV

HIBANA_SPARE_LOWV

HIB_1P8V_DET_EN

HIB_1P8V_DET_EN

HIB_1P2_1P8_LDO_TRIM

HIB_1P2_1P8_LDO_TRIM

HIB_COMP_TRIM

HIB_COMP_TRIM

HIB_EN_TS

HIB_EN_TS

HIB_NHIB_ENABLE

HIB_NHIB_ENABLE

HIB_TMUX_CTRL

HIB_TMUX_CTRL

HIB_UART_RTS_SW_ENABLE

HIB_UART_RTS_SW_ENABLE

HIB_VBAT_MON_EN

HIB_VBAT_MON_EN

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MEM_BGAP_PARAMETERS0

MEM_BGAP_PARAMETERS1

MEM_BGAP_PARAMETERS1

MEM_GPIO_WAKE_CONF

MEM_GPIO_WAKE_CONF

MEM_GPIO_WAKE_EN

MEM_GPIO_WAKE_EN

MEM_HIB_CONFIG

MEM_HIB_CONFIG

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MEM_HIB_DETECTION_STATUS

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MEM_HIB_LPDS_GPIO_SEL

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MEM_HIB_MISC_CONFIG

MEM_HIB_MISC_CONTROLS

MEM_HIB_MISC_CONTROLS

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MEM_HIB_REG0

MEM_HIB_REG1

MEM_HIB_REG1

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MEM_HIB_REG2

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MEM_HIB_REG3

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MEM_HIB_REQ

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MEM_HIB_RTC_IRQ_ENABLE

MEM_HIB_RTC_IRQ_LSW_CONF

MEM_HIB_RTC_IRQ_LSW_CONF

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MEM_HIB_RTC_IRQ_MSW_CONF

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MEM_HIB_RTC_TIMER_ENABLE

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MEM_HIB_RTC_TIMER_LSW

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MEM_HIB_RTC_TIMER_READ

MEM_HIB_RTC_TIMER_READ

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MEM_HIB_RTC_TIMER_RESET

MEM_HIB_RTC_WAKE_EN

MEM_HIB_RTC_WAKE_EN

MEM_HIB_RTC_WAKE_LSW_CONF

MEM_HIB_RTC_WAKE_LSW_CONF

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MEM_HIB_RTC_WAKE_MSW_CONF

MEM_HIB_SEQUENCER_CFG0

MEM_HIB_SEQUENCER_CFG0

MEM_HIB_SEQUENCER_CFG1

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MEM_HIB_SEQUENCER_CFG2

MEM_HIB_UART_CONF

MEM_HIB_UART_CONF

MEM_HIB_WAKE_STATUS

MEM_HIB_WAKE_STATUS

MEM_INT_OSC_CONF

MEM_INT_OSC_CONF

MEM_JTAG_CONF

MEM_JTAG_CONF

MEM_PAD_OEN_RET33_CONF

MEM_PAD_OEN_RET33_CONF

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MEM_UART_RTS_OEN_RET33_CONF

MEM_XTAL_OSC_CONF

MEM_XTAL_OSC_CONF